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FPLL实际应用介绍 FPLL实际应用介绍 名词解释 名词解释 • 什么是Frame sycn? • 什么是Frame sycn? 狭义的说: 让Output V sync freq与Input V sync freq相同. 狭义的说: 让Output V sync freq与Input V sync freq相同. 例如: Input V Freq 60Hz, Output V Freq也等於60. 例如: Input V Freq 60Hz, Output V Freq也等於60. 广义的说: 让Output V sync freq与Input V sync freq 保持 广义的说: 让Output V sync freq与Input V sync freq 保持 一定比例关系. 一定比例关系. 例如: Input V Freq 60Hz, Output V Freq等于120Hz. 例如: Input V Freq 60Hz, Output V Freq等于120Hz. • 目前常用的Frame sycn有以下两种方式： • 目前常用的Frame sycn有以下两种方式： 1 ，Frame PLL MODE 1 ，Frame PLL MODE a, Frame PLL的运作方式简单的说是固定住Output H total a, Frame PLL的运作方式简单的说是固定住Output H total and V total, 然后IC会自动调整(微调)Output clock來使 and V total, 然后IC会自动调整(微调)Output clock來使 得Output V Freq接近Input V Freq. 得Output V Freq接近Input V Freq. b，IC通常只是微調Output clock, 所以SW在启动Frame PLL b，IC通常只是微調Output clock, 所以SW在启动Frame PLL mode之前,必须先填好一組接近的Output clock! 否则有 mode之前,必须先填好一組接近的Output clock! 否则有 可能发生Lock不住的情形. 可能发生Lock不住的情形. • 举例: • 举例: 假设Input V Freq=50Hz, 所以我们预期的Output V Freq也是50Hz, 假设Input V Freq=50Hz, 所以我们预期的Output V Freq也是50Hz, 所以Output clock应等于PANEL_HTOTAL*PANEL_VTOTAL*50 所以Output clock应等于PANEL_HTOTAL*PANEL_VTOTAL*50 再通过公式： 再通过公式： Dclk = XTAL * MM * 524288 * LM * K / (SET * A), 其中 Dclk = XTAL * MM * 524288 * LM * K / (SET * A), 其中 • Dclk = Htt * Vtt * FR • Dclk = Htt * Vtt * FR • XTAL为系统使用的晶振频率，通常为12MHz • XTAL为系统使用的晶振频率，通常为12MHz • MM: MM * XTAL/MHz 必须等于216，所以MM = 216/12 = • MM: MM * XTAL/MHz 必须等于216，所以MM = 216/12 = 18 18 • LM建议值为8 （T3 ，ursa3等新IC，建议值为16） • LM建议值为8 （T3 ，ursa3等新IC，建议值为16） • K建议值为1 • K建议值为1 • A ：LVDS dual channel時為3.5，single channel的話為7 • A ：LVDS dual channel時為3.5，single channe