第六章 时序逻辑电路的分析和设计 11.ppt

6.1.4 计数器 一．二进制同步计数器 （1）二进制同步加法计数器 （2）二进制同步减法计数器 分析4位二进制同步减法计数器的状态表，很容易看出，只要将各触发器的驱动方程改为： 当控制信号X=1时，FF1～FF3中的各J、K端分别与低位各触发器的Q端相连，作加法计数。 2．集成二进制计数器举例 ① 异步清零。 （2）4位二进制同步可逆计数器74191 二、非二进制计数器 N进制计数器又称模N计数器。 例：十进制计数器设计 然后将各驱动方程代入JK触发器的特性方程，得各触发器的次态方程: （3）作状态转换表。 （4）作状态图 和时序图。 （5）检查电路能否自启动 用同样的分析方法分别求出6种无效状态下的次态，得到完整的状态转换图。 3．集成十进制计数器举例 （1）8421BCD码同步加法计数器74160 三、集成计数器的应用 （2）用计数器的输出端作进位/借位端 有的集成计数器没有进位/借位输出端，这时可根据具体情况， 用计数器的输出信号Q3、Q2、Q1、Q0产生一个进位/借位。 2．组成任意进制计数器 （1）异步清零法——适用于具有异步清零端的集成计数器。 （2）同步清零法 同步清零法适用于具有同步清零端的集成计数器。 例：用集成计数器74163和与非门组成的6进制计数器。 （3）异步预置数法 异步预置数法适用于具有异步预置端的集成计数器。 例：用集成计数器74191和与非门组成的余3码10进制计数器。 （4）同步预置数法 同步预置数法适用于具有同步预置端的集成计数器。 例：用集成计数器74160和与非门组成的7进制计数器。 例1 用74160组成48进制计数器。 6.1.5 数码寄存器与移位寄存器 74LS175的功能: RD是异步清零控制端。 二、移位寄存器 移位寄存器——不但可以寄存数码，而且在移位脉冲作用下，寄存器中的数码可根据需要向左或向右移动1位。 设移位寄存器的初始状态为0000，串行输入数码DI=1101，从高位到低位依次输入。其状态表如下： 右移寄存器的时序图： 由于右移寄存器移位的方向为DI→Q0→Q1→Q2→Q3，所以又称上移寄存器。 （2）左移寄存器 2 ．双向移位寄存器 将右移寄存器和左移寄存器组合起来，并引入一控制端S便构成既可左移又可右移的双向移位寄存器。 当S=1时，D0=DSR、D1=Q0、D2=Q1、D3=Q2，实现右移操作； 三、集成移位寄存器74194 74194为四位双向移位寄存器。 74194的功能表 四、移位寄存器构成的移位型计数器 1. 环形计数器 2．扭环形计数器 为了增加有效计数状态，扩大计数器的模，可用扭环形计数器。 本章小结 1．时序逻辑电路的特点；任一时刻输出状态不仅取决于当时的输入信号，还与电路的原状态有关。因此时序电路中必须含有存储器件。 先将两芯片采用同步级联方式连接成100进制计数器， 然后再用异步清零法组成了48进制计数器。 解：因为N＝48，而74160为模10计数器，所以要用两片74160构成.。 例2 用74161组成12进制计数器。 0 1 2 3 4 5 6 7 8 9 10 11 计数脉冲序号 电 路 状 态 0 0 0 0 0 1 0 1 * 0 1 1 0 0 1 1 1 1 0 0 0 1 0 0 1 1 0 1 0 1 0 1 1 1 1 0 0 1 1 0 1 1 1 1 0 1 1 1 1 Q3 Q2 Q1 Q0 0 1 2 3 4 5 6 7 8 9 10 11 计数脉冲序号 电 路 状 态 0 0 0 0 0 0 1 1 * 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 0 0 0 1