[工学]43 常用组合逻辑电路2-译码器.pptVIP

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2018-02-24 发布于浙江
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[工学]43 常用组合逻辑电路2-译码器.ppt

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[工学]43 常用组合逻辑电路2-译码器

七段显示译码器7448的功能表作业 4.7 4.11 Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 A2 A1 A0 E 3-8译码器 1 译码器的每一个输出端代表了相应输入变量的最小项。 5．用译码器设计组合逻辑电路例如，试用3-8线译码器实现逻辑函数：解：首先将表达式转换为最小项表达式 F= (AB+AB) C = AB+AB C + (AB+AB) C =ABC+ABC+ABC+ABC =m1+ m7 + m4 + m2 A B C Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 A2 A1 A0 3线／8线译码器 E F ≥1 1 * 4.3 常用组合逻辑集成模块及其应用 4.3.1 加法器半加器与全加器 (1) 半加器 (2) 全加器 2．加法器 (1) 串行进位加法器 (2) 超前进位加法器 3. 加法器应用 a3 a2 a1 a0 b3 b2 b1 b0 1 S A3 A2 A1 A0 B3 B2 B1 B0 S3 S2 S1 S0 CI CO a3 a2 a1 a0 S3 S2 S1 S0 CO S A3 A2 A1 A0 B3 B2 B1 B0 S3 S2 S1 S0 CI b3 b2 b1 b0 A-B = A+ B+1 ? ? M b3 =1 ? b2 =1 b1 =1 b0 =1 ? a3 a2 a1 a0 S3 S2 S1 S0 CO S A3 A2 A1 A0 B3 B2 B1 B0 S3 S2 S1 S0 CI 当M=0时执行A+B B 0=B 当M=1时执行A-B B 1=B 0 0 1 1 8421BCD 码余三码 CO S A3 A2 A1 A0 S3 S2 S1 S0 CI B3 B2 B1 B0 余三码 CO S A3 A2 A1 A0 S3 S2 S1 S0 CI B3 B2 B1 B0 1 1 0 0 1 0 8421BCD 码 2．普通编码器二进制编码器 4.3.2 编码器 1. 概述 m≤2n I0 I1 I2 I3 I4 I5 I6 I7 Y2 Y1 Y0 输入输出 1 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 1 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0 1 1 1 输入变量用“0”表示有信号输入,“1”表示无信号输入;输出变量用反码表示。二-十进制编码器 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 1 0 输入输出 I0 I1 I2 I3 I4 I5 I6 I7 I8 I9 Y3 Y2 Y1 Y0 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 0 0 0 1 0 0 1 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 0 0 0 1 3．优先编码器 8-3线优先编码器真值表输入输出 × ×