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[理学]数字信号处理 课件 03
NanKai University
第二章
DSP的硬件结构
（2）
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§2.4 CPU状态寄存器
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C54x有三个状态和控制寄存器，分别为：
状态寄存器ST0 (MMR:06h)
状态寄存器ST1 (MMR:07h)
处理器工作方式状态寄存器PMST (MMR:1Dh)
ST0 包括了算术运算和位操作使用的状态位；
ST1 反映了处理器和指令执行所依据的模式和状态；
PMST 包括存储器配置状态和其他控制信息。
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一、状态寄存器ST0
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ST0的结构如下：
15－13 12 11 10 9 8 －0
ARP TC C OVA OVB DP
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二、状态寄存器ST1
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ST1的结构如下：
15 14 13 12 11 10 9 8 7 6 5 4-0
BRAF CPL XF HM INTM 0 OVM SXM C16 FRCT CMPT ASM
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