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EDA实现多功能数字钟实验报告
EDA实现多功能数字钟
实
验
报
告
专业班级：10通信工程2班
姓名：许同洲
学号：100103021110
指导老师：惠志敏
日期：2012年月24日 实验任务：
用FPGA器件和EDA技术实现多功能数字钟的设计
已知条件：1、MAX+PLUS II软件
2、FPGA实验开发装置
基本功能：1、以数字形式显示时、分、秒的时间；
2、小时计数器为24进制。
3、分、秒、计数器为60进制。
扩展功能：1、校时、校分（有两个使能端构成，分别为校时、校分功能，同时按无效）
2、仿电台报时（每个小时的59分51、53、55、57、59分别以四长声一短声进行报时）
3、时段控制（让信号显示灯在晚上19点至早上6点亮）
4、定点闹时（让闹钟每天早上7点闹时）
主体电路部分：
图1 60进制秒钟计数器
图2 60进制分钟计数器
图3 24进制计数器
图4 24小时时钟
仿真结果：
图5 60进制计数器
图6 24进制计数器
图7 24小时时钟
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