第三章 组合逻辑电路 第一节 组合电路的分析和设计 第二节 组合逻辑电路中的竞争与冒险 第三节 超高速集成电路硬件描述语言VHDL 第四节 组合逻辑电路模块及其应用.pptVIP

一、VHDL的基本组成 （一）参数部分——程序包 (二）接口部分—设计实体 (二）接口部分—设计实体 （三）描述部分—结构体 二、VHDL数据类型和属性 在VHDL中目标有三种：信号、变量和常量。 目标：是一个或多个代表着目标种类的字符串，多个目 标时用“,”号分开。 TYPE 类型名 IS 类型范围 ; PACKAGE meals_pkg IS TYPE meal IS(breakfast,lunch,dinner);END meals_pkg; 2.复合数据类型 VHDL的属性 TYPE bit1 IS ARRAY(63 DOWNTO 32) OF BIT;  VARIABLE left_range,right_range,uprange,lowrange:INTEGER;BEGIN left_range:= bit1’LEFT; --returns 63  right_range:= bit1’RIGHT; --returns 32  uprange:= bit1’HIGH; --returns 63  lowrange:= bit