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0.35um cmos工艺多频点输出锁相环电路设计 word格式
了流片和初步测试,达到了预期的目标。测试的结果表明:输出频点可达125MHz,VCO的调节范围是180M~437M,在240M工作频率的相位噪声是-111dBC/Hz@1MHz,功耗小于40mW。可应用于:手机, 数字电视,掌上电脑, 数字电视复位,全球定位系统,数码相机和数码相框。关键词:多频点,电荷泵锁相环,环形振荡器,鉴相器,低通滤波器.IIABSTRACTWiththedevelopmentoftheintegratedcircuittechnology, communicationsystemsandmicroprocessorsusuallyneeddifferentfrequenciesfordifferentfunctionalapplications.ThePLLcircuitplays averyimportantroleintheICsandon-chipsystems,isthemostchallenging areasoftheanalogintegratedcircuit design.Thisthesisusesafrequencysynthesizerwhichowesachargepump PLLwiththeadvantagesoflowpower,smalllockdifference,lowjitterandwidecapturerange.Frequencysynthesizerincludesaphasedetector,achargepump,alowpassfilterandasimpleringVCOtoachievelownoise, highgainandhighlinearityofthephase-lockedloop.Thisthesisuses0.35umCMOSprocesstosimulateanddothelayoutofthecircuits.Eachblockofthephase-lockedloopcircuithas been studiedindetails,andinaccordancewithapredeterminedmultiplefrequenciesoutputswhichdesignedtomeettheperformanceofthecircuitoftheloopparameterstominimizethenoise.Thedesignmethodofloop parametersisdifferentfromthemethodofsinglefrequencydesign,sothatneedtoanalysistheloopparametersofthedifferentfrequencies.And furthermoreneedtostudyitsoperationprinciple,mathematicalmodeland elementarycharacteristics.Thedifficultyofmulti-outputs design is theloopparameters,becauseofthedifferentfrequencies.ThedifferentdividerNofPLLwillaffectthedesignofloopparameters.Sousemeansquarevaluesandproveithasgoodnoiseintherangeofdemandedfrequenciesbytheevaluation.AnotherdifficultyofthethesisistodesignaVCOwithlownoiseand widefrequencyrange.Thisdesignusesanoriginalcurrentsourceand othermethodstodesignareasonableKVCOandgoodlinearity.ThevalueofKVCO is 100MHz/V.SimulatethecircuitbyHSPICE,furthermoremanufactureandtestIIIthe circuittoobtainthe resultsachievingthedesired objectives. Thetestresultsshows:theoutputfrequencycanreach250MHz, the outputfrequencyrangeofVCOis180M~437M,thephasenoiseofthecenterfrequency240MHZis-111dBc/Hz@1MHzanditspowerconsumptioni
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