哈工大数字逻辑第3章.ppt

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2018-04-23 发布于湖北
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哈工大数字逻辑第3章

表达式转换半加器 ? 实现1： 1. 串行进位二进制并行加法器例:判断F=(A+B)(A+C)(B+C)描述的电路是否可能出现险象险象的消除组合逻辑电路设计总结一、应用数据选择器设计组合电路 (1) m = n 组合电路变量个数数据选择器地址端个数一般方法：将函数的n个变量依次连接到MUX的n个选择端，并将函数表示成最小项之和的形式。若函数表达式中包含最小项mi，则相应MUX的 Di 接1，否则 Di 接0。例1 用八选一实现：F = AB＋AC＋BC A2A1A0 y 0 0 0 D0 0 0 1 D1 0 1 0 D2 0 1 1 D3 1 0 0 D4 1 0 1 D5 1 1 0 D6 1 1 1 D7 A2 y A1 A0 D0 D1 D2 D3 D4 D5 D6 D7 D2 D3 D1 D6 D7 D5 D4 D0 00 01 11 10 0 1 A2 A1 A0 1 0 1 1 1 1 1 0 00 01 11 10 0 1 A BC 要设计的组合电路的卡诺图比较 “1” A B C F (2) m = n + 1 组合电路变量个数数据选择器地址端个数一般方法：降维，再应用 m = n 的方法例2 用八选一实现： F(A,B,C,D)=∑m(1,5,6,7,9,11,12,13,14) 0 1 1 0 1 0 1 1 1 1 1 0 0 0 1 0 00 01 11 10 00 01 11 10 AB CD 降维 D D D D 1 D D D 1 0 D D 1 3 7 5 2 4 8 6 1 2 4 3 5 6 8 7 000=0 D ＋1 D=D 100 =0 D ＋1 D=D 001 =0 D ＋0 D=0 101=0 D ＋1 D=D 010 =0 D ＋1 D=D 110 =0 D ＋1 D=1 011 =1 D ＋1 D=1 111 =1 D ＋0 D=D 00 01 11 10 0 1 A BC F(A,B,C,D)=∑m(1,5,6,7,9,11,12,13,14) A2 y A1 A0 D0 D1 D2 D3 D4 D5 D6 D7 A B C F D “1” 1 D D D 1 0 D D 00 01 11 10 0 1 A BC 比较 D2 D3 D1 D6 D7 D5 D4 D0 00 01 11 10 0 1 A2 A1 A0 要设计的组合电路的卡诺图 (3) m = n + 2 组合电路变量个数数据选择器地址端个数一般方法：降维，再应用 m = n 的方法例2 用四选一实现： F(A,B,C,D)=∑m(0,1,5,6,7,9,10,14,15) 1 0 1 0 1 1 0 0 1 1 1 0 0 0 1 1 00 01 11 10 00 01 11 10 AB CD 降维 C C+D 0 1 0 1 A B + C D 降维 A1 y A0 D0 D1 D2 D3 A B + + C D F 0 1 D D 1 0 1 D 00 01 11 10 0 1 A BC C D D D D 例3 用多个四选一实现： F(A,B,C,D,E)=∑m(0,5,8,9,10,11,17,18,19,20,22,23,28,30,31) 0 1 1 1 0 1 1 1 0 0 1 0 0 0 1 0 0 1 1 0 0 0 1 0 0 0 1 1 0 0 1 0 0 0 0 1 1 0 1 1 00 A B C D E F 0 0 0 1 1 0 1 1 01 0 0 1 0 0 0 1 0 0 1 1 0 0 1 1 1 0 0 1