第11章 直接数字频率合成器的精品.pptVIP

① 在输入环节加入了一个数据锁存器，用“软设置”代替按键“硬设置”；② 在ROM的验证中，降低了系统的设计规模，减少了系统对逻辑资源的需求。其他类似问题也可参照该方法解决。这在实际的开发设计中，是在硬件验证中最常用也最重要的一种办法。 11.6 系统扩展思路 (1) 根据图11.1，在上述已有设计的基础上，加上相位控制字，将一个具有频率控制和相位控制的DDS的核心部分(相位累加器)重新进行设计和硬件验证：① 使用VHDL程序设计的方法；② 使用参数可设置的LPM兆功能块调用的方式进行设计。 (2) 在用FPGA设计好DDS的核心模块(相位累加器)后，加上DAC电路和LPM电路，构成一个完整的DDS，并用数字示波器等仪器设备进行实际测试，直到达到设计要求为止。 第11章 直接数字频率合成器的设计与分析 第11章 直接数字频率合成器的设计与分析 11.1 系统设计要求 11.2 系统设计方案 11.3 主要VHDL源程序 11.4 系统仿真/硬件验证 11.5 设计技巧分析 11.6 系统扩展思路 11.1 系统设计要求 1971年，美国学者J.Tierncy、C.M.Reader和B.Gold提出了以全数字技术从相位概念出发直接合成所需波形的一种新的频率合成原