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第3章 硬件描述语言Verilog HDL 3.1 引言 3.2 Verilog HDL基本结构 3.3 数据类型及常量、变量 3.4 运算符及表达式 3.5 语句 3.6 不同抽象级别的Verilog HDL模型 3.7 设计技巧 采用的描述级别越高，设计越容易，程序代码越简单；但耗用器件资源更多。对特定综合器，可能无法将某些抽象级别高的描述转化为电路！ ??基于门级描述的硬件模型不仅可以仿真，而且可综合，且系统速度快。 ??所有Verilog HDL编译软件只是支持该语言的一个子集。 ??尽量采用编译软件支持的语句来描述设计；或多个软件配合使用。 ??一般用算法级（写出逻辑表达式）或RTL级来描述逻辑功能，尽量避免用门级描述，除非对系统速度要求比较高的场合才采用门级描述。 思考： （1）采用什么描述级别更合适？ ?? 系统级描述太抽象，有时无法综合成具体的物理电路；门级描述要求根据逻辑功能画出逻辑电路图，对于复杂的数字系统很难做到；??而算法级和RTL级描述级别适中，代码不是很复杂，且一般容易综合成具体的物理电路，故建议尽量采用算法级和RTL级来描述。 （2）怎样减少器件逻辑资源的耗用？ ?? 当器件容量有限时，为减少器件逻辑资源的耗用，建议少用if-else语句和case语句，尽量直接使用逻辑表达式来描述系统的逻辑功能；??或者用case语句取代if-else语句。 小结 * *
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