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2018-04-30 发布于天津
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数字逻辑设计课程设计 2012029170009 丁启程 1.设计要求：可控加法器的设计设计一个8位加法器，输入为8位数据A、B，一位的进位信号CIN，及控制信号S1、S0，输出为和S。具体功能如下表所示： S1 S0 S（和） 0 0 B加A’加CIN 0 1 B加A加CIN 1 0 A’加CIN 1 1 B’加CIN 采用4位加法器74x283作为基本构造块，设计能实现以上操作的电路并验证。设计过程由功能表： S1 S0 S（和） 0 0 B加A’加CIN 0 1 B加A加CIN 1 0 A’加CIN 1 1 B’加CIN 可列出真值表： S1 S0 A A’ B B’ S 0 0 0 1 1 0 A’+B+CIN 0 1 1 0 1 0 A+B+CIN 1 0 0 1 0 0 A’+CIN 1 1 0 0 0 1 B’+CIN 所以可得：S=A*S0*S1’+A’*S0’*S1’+B*S1’+B’*S1*S0 A*S0*S1’由此方式完成： A’*S0’*S1’由此方式完成： B*S1’由此方式完成： B’*S1*S0由此方式完成：再使用加法器即可。完整电路如图：其中完成4个8位二进制数相加的加法器部分如图：仿真结果: A,B,S0,S1,CIN如图所示：字发生器XWG1从31-24为8位二进制数A，从23-16为8位二进制数B，根据上图，AB 字发生器XWG2从31-29分别为CIN,S0,S1的取值，根据上图CIN=1,S0=1,S1=1。以上逻辑分析仪对象1-对象8为加法器8位输出S，由图可知，在以上条件下，S0=1111110，满足功能表中S0=1，S1=1时，S=B’+CIN的描述，改变A,B,S0,S1,CIN的值，仿真结果也符合题目中对该可控加法器的功能描述。