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第1章 计算机概述 1.1 计算机的发展概况 1.1.1 计算机的产生和发展 电子计算机是由各种电子器件组成的，是能够自动、高速、精确地进行算术运算、逻辑控制和信息处理的现代化设备。自从其诞生以来，已被广泛应用于科学计算、数据（信息）处理和过程控制等领域。 第2章 计算机中信息的表示方法 第3章 中央处理器 3.1.1 CPU的基本概念和组成 中央处理器（Central Processing Unit，即CPU）是计算机硬件系统的核心部件，控制和指挥着整个计算机系统的工作，是采用大规模或超大规模集成电路技术做成的半导体芯片。 CPU由控制器、运算器和寄存器组三个基本部分组成。 1. 控 制 器 控制器是整个计算机系统的控制指挥中心。它主要由以下几部分组成： （1）程序计数器PC。 （2）指令寄存器IR。 （3）指令译码器ID。 （4）地址形成部件。 （5）可编程逻辑阵列PLA。 （6）时序部件。 2. 运 算 器 （1） 累加器。 （2） 加法器。 （3） 寄存器组。 3. 寄 存 器 组 寄存器组用来存储控制器和运算器工作过程中的数据、中间结果和一些运算结果的状态标志。它主要分为通用寄存器和专用寄存器两大类。 地址寄存器AR 数据缓冲寄存器DR 标志寄存器FLAGS 3.1.2 CPU的主要技术参数 1. 位、字节和字长 2. 主频 3. 外频 4. 倍频系数 5. 前端总线（FSB）频率 6. 高速缓冲存储器（Cache) 3.1.3 CPU主流技术术语浅析 1. 流水线技术 2. 超流水线技术 3. 超标量技术 4. 乱序执行技术 5. 分枝预测和推测执行技术 6. 指令集 : X86指令集 , CISC指令集 , RISC指令集 7. CPU扩展指令集 8. CPU内核和I/O工作电压 9. IA-32、IA-64架构 10. 封装形式 3.2 8086/8088微处理器 1. 8086的内部结构框图 2. 8086的系统组成 3. 8086的工作模式和引脚功能 4. 8086的总线时序 3.2.1 8086的内部结构框图 3.2.2 8086的系统组成 8086的系统由执行单元EU和总线接口单元BIU组成。 执行单元EU包括8个16位通用寄存器、暂存寄存器、算术逻辑单元ALU和标志寄存器。负责全部指令的译码执行和数据运算，负责向总线接口单元BIU提供偏移地址，对通用寄存器和标志寄存器进行管理。 总线接口单元BIU包括段寄存器CS，SS，DS，ES和指令寄存器IP、通信寄存器、指令队列和产生物理地址的加法器∑。负责管理系统总线和指令队列。CPU所有的对外操作都是由BIU完成的，包括预取指令到指令队列、访问内存或外设中的操作数、响应外部的中断请求和总线请求，等等 。 3.2.3 8086的工作模式 1. 最小工作模式 最小工作模式是指系统中只有一个微处理器，即8086，系统的控制信号由其直接产生。 2. 最大工作模式 最大工作模式又称多处理器系统，系统中存在两个或两个以上的微处理器，这时，系统的控制信号大部分由与之配合的总线控制器芯片8288产生。 3.2.4 8086的总线时序 CPU的各种操作是在其内部系统时钟CLK的控制下严格定时的。 时钟周期：是CPU的基本时间计量单位，由CPU的主频决定，如8086的主频为5MHz，则1个时钟周期就是200ns。 一个时钟周期又称为一个T状态。 3.2.4 8086的总线时序 总线周期（机器周期）：CPU从存储器或I/O端口存取一个字节所需的时间。 8086CPU基本的总线周期由4个时钟周期组成，因此基本总线周期用T1、T2、T3、T4表示。 8086的总线周期如下图所示。 3.2.4 8086的总线时序 指令周期：CPU执行一条指令所需要的时间。由若干个机器周期组成。 8086CPU在与存储器或I/O端口交换数据时需要启动一个总线周期。 按照数据的传送方向来分，总线周期可分为读总线周期（CPU从存储器或I/O端口读取数据）和写总线周期（CPU将数据写入存储器或I/O端口）。 3.2.4 8086的总线时序 读总线周期 一个存储器的读周期由4个T状态组成。 在T1状态，CPU把要读的存储单元或I/O端口的地址放到地址总线上。 在T3、T4状态期间，CPU从总线上接收数据。 T2状态时总线浮空，允许CPU有个缓冲时间把输出地址的写方式转换成输入数据的读方式。 3.2.4 8086