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三、实验设计与调试 1.使用Quartus软件完成电路设计 2. 对电路进行仿真测试，并分析结果 3. 下载后在实验板连线做硬件验证测试 Xi’an Jiaotong University Xi’an Jiaotong University Xi’an Jiaotong University 实验四 触发器与计数器实验 一、实验目的 1.了解RS触发器、JK触发器、D触发器逻辑功能 2.了解同步计数器、异步计数器的使用方法 3.掌握任意模计数器的构成方法 4.了解逻辑电路的竞争冒险现象及其消除方法 二、实验内容 1. 测试RS触发器、JK触发器、D触发器逻辑功能 (选作） 图4.2 与非门组成的基本RS触发器 （a） 逻辑电路 （b）逻辑符号 R为置0端（或复位端） S为置1端（或置位端） 非号“－”：表示低电平有效 2. 计数器电路设计实验 下图是用集成计数器74161按照反馈清零法设计的一个十二进制计数器，请用Quartus软件仿真调试验证电路能否正常工作。 如果这个电路有问题，请修改电路设计并调试正确。 3. 基于广义译码器的计数器设计 一般计数器可用一个广义译码器和一个寄存器构成。需要改变计数器的模，可通过修改译码器真值表的方法构成任意模计数器。更进一步还可实现所需要的逻辑状态转换功能（状态机）。 加‘1’译码器 4D触发器构成 的寄存器F44 用VHDL语言描述的译码器 ADDER1 寄存器f44内部电路 真值表 实体名必须与文件名同名 实体名 谢谢！
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