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例:分析图示逻辑电路的逻辑功能,说明其用处。 设初始状态为“000”。 2.列写状态转换表，分析其状态转换过程 * 14.1 双稳态触发器 第 14 章 触发器和时序逻辑电路 14.2 寄存器 14.4 由 555 定时器组成的单稳 态触发器和无稳态触发器 14.3 计数器 14.5 应用举例 六进制计数器 Q3 Q2 Q1 Q0 S9(1) S9(2) R0(1) R0(2) C0 C1 CP0 Q3 Q2 Q1 Q0 S9(1) S9(2) R0(1) R0(2) C0 C1 CP0 九进制计数器 ?例 1? 数字钟表中的分、秒计数器都是六十进制，试用两片CT74LS290 型二 – 五 – 十进制计数器联成六十进制电路。 ?解? 六十进制计数器由两位组成，个位(1)为十进制，十位(2)为六进制。个位的最高位 Q3 联到十位的 CP0 ，个位十进制计数器经过十个脉冲循环一次，每当第十个脉冲来到后 Q3由 1 变为 0，相当于一个下降沿，使十位六进制计数器计数。经过六十个脉冲，个位和十位计数器都恢复为 0000。 Q3 Q2 Q1 Q0 S9(1) S9(2) R0(1) R0(2) C0 C1 Q3 Q2 Q1 Q0 S9(1) S9(2) R0(1) R0(2) C0 C1 CP0 个位(1) 十位(2) 例：画出可控 R－S 触发器的输出波形 R S C 不定 不定 可控 R－S状态表 C高电平时触发器状态由R、S确定 Q Q 0 1 0 0 S R 0 1 0 1 0 1 1 1 不定 Qn+1 Qn 存在问题： 时钟脉冲不能过宽，否则出现空翻现象，即在一个时钟脉冲期间触发器翻转一次以上。 C 克服办法：采用 JK 触发器或 D 触发器 0 0 S R 0 1 0 1 0 1 1 1 不定 Qn+1 Qn Q=S Q=R 例：JK 触发器工作波形 C J K Q 下降沿触发翻转 例：D 触发器工作波形图 C D Q 上升沿触发翻转 用D触发器构成三位二进制异步加法器 ？ ？ 2、若构成减法计数器C又如何连接？ 思考 1、各触发器C应如何连接？ 各D触发器已接成T′触发器，即具有计数功能 C 清零 RD Q D Q Q0 F0 Q D Q Q0 F0 Q D Q Q3 F3 RD Q J K Q Q0 F0 Q J K Q Q1 F1 Q J K Q Q2 F2 C 计数脉冲 解：1. 写出各触发器 J、K端和C端的逻辑表达式 C0= C K0 =1 J0 =Q2 K1 =1 J1 =1 C1= Q0 J2=Q0Q1 K2 =1 C2= C RD Q J K Q Q0 F0 Q J K Q Q1 F1 Q J K Q Q2 F2 C 计数脉冲 解：当初始状态为“000”时， 各触发器J、K端和C端的电平为 C0= C=0 K0 =1 J0 =Q2=1 K1 =1 J1 =1 C1= Q0=0 J2=Q0Q1=0 K2 =1 C2= C=0 RD Q J K Q Q0 F0 Q J K Q Q1 F1 Q J K Q Q2 F2 C 计数脉冲 0 1 1 1 1 1 C J2=Q0Q1 K2 =1 J1 = K1 =1 K0 =1 J0 =Q2 Q2 Q1 Q0 0 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 0 1 0 1 1 1 1 1 0 0 0 0 1 0 0 1 2 0 1 0 3 0 1 1 4 1 0 0 5 0 0 0 由表可知，经5个脉冲循环一次，为五进制计数器。 C1= Q0 由于计数脉冲没有同时加到各位触发器上，所以为异步计数器。 *