高速突发模式误码测试仪的FPGA实现方案来源互联网摘要突发.DOC

高速突发模式误码测试仪的FPGA实现方案 来源：互联网 摘要：突发模式误码测试仪与一般连续误码测试仪不同，其接收端在误码比对前要实现在十几位内，对具有相位跳变特点的信号进行时钟提取和数据恢复，并且在误码比对时须滤除前导码和定界符，仅对有效数据进行误码统计。本文提出一种基于FPGA实现的高速突发模式误码测试仪设计方案，并介绍该方案的总体设计过程，以及FPGA中主要功能逻辑模块的工作原理和控制系统的设计。该测试仪应用于1．25 GHz GPON系统突发式光接收模块的误码测试中，具有较好的性能和实际意义。 引言 无源光网络PON以其独特的优势在网络中已经规模化地应用。由于GPON系统在现有PON系统中带宽利用率最高，系统成本最低，且具有全业务支持能力，因此其前景被普遍看好，成为众多电信运营商和设备制造商推崇的宽带接入技术。 在GPON中，下行数据是以广播形式发送的，上行数据由多个用户终端按时分多址的方式发送的数据包组成。因传输路径不同，各数据包有不同衰减，不同数据包相位间存在跳变，数据包中存在长连“1”、“0”，这些因素的影响使得OLT突发接收模块接收的信号是特殊的突发光信号。对于上行的突发信号，OLT突发接收模块不仅要从中恢复出幅值相等的信号，而且要消除相位突变，即完成时钟和相位的对齐，因此OLT输出的信号应该为幅值相等且时钟和相位对齐的电信号。本突发模式误码测试仪的作用是，准确地判断被测的OLT突发接收模块的完成幅值恢复响应时间和其可靠性。 1 突发模式误码测试原理 与一般连续误码测试仪相同的是，突发误码测试仪也由发送和接收两部分组成。发送部分发送可预知的信号作为测试信号来模拟实际信道中传输信号，并将该信号送到待测设备中；接收部分产生与发送部分相同的信号，用以和接收的信号逐位比对，并统计误码数和误码率。 与一般连续误码测试仪不同的是，突发误码测试仪发送部分发送的测试信号要模拟突发信号，即具有相位突变和幅度不均衡的特点。此外，接收部分要从接收到的可能存在相位跳变信号中准确地提取时钟和恢复数据。 根据突发误码测试仪的特点，其总体设计框图如图1所示。 突发接收模块(BMRx)是要测试的模块。突发误码测试仪用FPGA逻辑来实现两路时分复用(TDMA)数据的输出，两路数据先分别通过光可变衰减器不同幅度的衰减后，再经过不同长度的光纤的时延，最后经过光合路器合为1路信号输出。光合路器的输出数据近乎于实际GPON中的上行突发信号，且假定信号在经过这些路径后没有出现误码。模拟的突发信号在经过待测突发接收模块后，经过包分离电路提取1路包数据(ON-U#1或ONU#2)，该路包数据最后经过突发模式时钟数据恢复芯片提取出时钟和4路并行数据。FPGA将提取的时钟作为误码比对的源时钟，并将4路并行数据重构造后与本地产生的数据进行比对，统计误码。 2 FPGA中逻辑功能模块设计 作为实现突发模式误码测试仪的重要芯片，FPGA主要实现如下功能： ①发送端产生两路高速的时分复用信号，这两路信号要具有GPON上行数据包的特点，即32位保护时间，44位前导码，20位定界符。 ②接收部分将接收到的4位宽的数据并化为8位宽的数据，并搜寻定界符将接收的数据进行边界对齐。 ③误码检测器将接收到的边界对齐后的数据与本地产生的伪随机码进行比对，仅对有效数据中出现的误码进行统计。 ④同步检测，失步后的重新同步。 图2为FPGA中实现的主要逻辑功能模块。 ①控制信号译码器根据Microblaze微处理器通过GPIO_IN输入的地址信息，将控制信息赋值给误码测试逻辑模块相应的控制信号。控制信息主要包括：包长度、保护时间长度、前导码长度、码型选择、GTP属性的DRP地址和值、时钟合成芯片的控制信息等。 ②状态编码器将误码测试模块的状态信息存储映射到不同地址的GPIO_OUT上，然后传送给Microblaze微处理器。输出的状态信息主要包括：误码比特数、接收到的总码数、同步状态、接收无信号等。 ③码型产生器模块包含PRBS产生器和数据包头产生器2个子模块。PRBS产生器根据码型选择控制信号产生相应码型的8位宽度伪随机序列，数据包头产生器模拟GPON上行数据包包头结构的特点中产生类似前导码和定界符的码型。码型产生器模块还包含1个数据包封装有限状态机，它的主要作用是产生发送码状态的控制信号，将包头数据、包间隔(保护时间)、CID(长连O／1)穿插在PRBS中以模拟GPON上行数据。包含两路包信号的数据txdata在与包分离信号相与后，分离成两路时分复用的信号txdata0和txdatal，时序如图3所示。 ④GTP0和GTPl为FPGA芯片的固核。它将低速的8位宽度的并行数据txdatal和txdata2串化为1路高速的串行数据，可以通过修改GTP的DRP属性来改变