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一种基于DSP网络数据处理系统研究 　　摘 要：目前，计算机技术、通信技术的发展有效的促进了网络数据采集系统普及和应用。本文基于DSP设计了一种具有主（ARM）、从（DSP）结构的网络数据处理系统，通过FPGA将其有效的集成在一起，能够实现数据的快速处理、实时的动态信号采集、可靠的网络传输等功能，满足了网络数据处理系统的要求。 　　关键词：数据处理；ARM；DSP；主从结构 　　中图分类号：TP274 　　目前，随着计算机、网络等技术的发展，已经在人们工作、生活的领域中得到了广泛的应用。数据采集是能够帮助人们实现各种业务功能，比如视频监控、远程过程控制等。由于人们工作的需要，在最大限度降低成本的基础上，数据采集的实时性和可靠性越来越重要。本文基于笔者多年的设计经验，基于DSP技术设计了一套主从结构的嵌入式网络化数据处理系统，能够大大的地降低数据采集和处理的成本，同时提供高可靠性的数据处理需求。 　　1 网络数据处理系统总体设计 　　本文数据采集和处理系统中，采用A/D和门阵列FPGA（fieldprogrammablegatearray）实现了数据的采集和处理功能[1]。本文系统设计过程中，使用DSP技术能够有效的实现数据采集、存储和分析等处理工作，大大的简化并降低主处理器ARM的工作压力，实现网络数据处理和监控的功能。基于主从结构的设计思想和DSP技术设计和开发嵌入式的数据采集、分析和处理系统，不但能够实现精确采集频数据信号，同时能够保证数据分析、处理的准确性、可靠性和实时性，系统稳定可靠。网络数据处理系统包括数据采集和控制、数据传输控制、网络传输、主从系统、主处理器ARM和从处理器DSP接口[2]。 　　数据采集控制可以使用DSP技术通过FPGA实时完成现场传感数据信号提取，并且能够实现A/D信号转换。由于DSP的运行速度比较高，同时要与主机ARM通信、完成数据处理功能，为了降低DSP的等待时间，在DSP与A/D转换芯片之间增加数据缓冲器，以便能够匹配高速DSP处理器件和低速数据采集功能，系统的数据采集和处理端以DSP技术为核心，并且采用缓冲的原则实现网络数据处理系统。数据采集芯片通过DSP控制数据采集功能，并且为FPGA提供控制参数， 　　DSP数据处理采用并行流水结构，具有片内外两级存储结构，独立的加法器和乘法器，能够大大的提高数据处理运行速度，DSP是网络数据处理系统的核心，其可以以启动A/D转换，并在现场读取传感器采集的数据，实施运算处理和存储，同时将处理结果通过主处理器ARM相连接的接口发挥。因此，使用DSP作为运算处理单元，其必将使得数据处理的能力大大的提高，并且能够有效的增强系统的数据采集能力，处理信号的能力。 　　为了能够增强系统信号处理和数据采集的能力，本文系统使用ARM和DSP的主从结构，系统包括两种类型的高、低速输入信号，高速信号设计为两路，低速信号设计为8路。ARM系统使用三星公司生产的S3C4510B作为主处理器，其能够完成网络通讯和系统管理工作；DSP采用了TI公司生产的TMS320C5416作为协处理器，其能够完成数据信号分析、处理的功能，包括实现傅里叶变换、互谱、平均等信号处理操作，特征抽取操作。这样的操作方式十分有利于让系统的主从处理器分别发挥系统处理能力，使得系统的数据采集工作和信号处理能力达到最大值，其可以有效的增强外部存储器的接口功能，使得系统预处理外部数据时更加的高效方便，并且增强了系统的实时性和可靠性。 　　2 网络数据处理系统详细设计 　　2.1 网络管理模块 　　基于DSP的网络数据处理系统的主处理器ARM使用了三星公司生产的S3C4510B，其包含一个16M的SDRAM和一个2M的FLASH，三星公司生产的S3C4510B性价比较高，其内含ARM7TDMI内核，并且在内部设置了一个10M/100M的以太网控制器，尤其适合网络数据采集和处理[3]。另外，该ARM同时拥有2个32位计数器、2个DMA通道、1个硬件12C接口、2个UART串口、2路HDLC、18个可编程I/O和中断控制器，S3C4510B的操作系统置放在FLASH存储器中，程序在SDRAM中运行，系统的主控制器提供一个10M/100M的以太网接口可以通过宽带连接，将系统接入到局域网或者因特网中，S3C4510B内嵌的以太网控制器，可以工作在半双工或者全双工的模式下，速率在10M/100M中切换。位于以太网控制器中的MAC层能够支持媒体独立接口，其提供DMA接口缓冲器，即能够支持ARM在25MHz的频率下以100Mb/S的速率实现数据的接收和发送操作，又能够支持ARM在2.5MHz的频率下，以10Mb/s的速率完成数据的发送和接收操作，尤其适合应用在网络数据传输过程中。 　　2.2 数据