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第8章 可编程接口芯片及应用 主要内容: 可编程定时器／计数器芯片8253／8254 可编程并行接口芯片8255A 串行通信及可编程串行接口芯片8251A 模／数与数／模转换技术及接口 8.1 可编程定时器/计数器芯片8253/8254 * * 定时信号的产生 1.软件定时 方法：根据所需时间常数设计一个延迟子程序。 优点：节省硬件 缺点：执行延时程序期间CPU一直被占用，降低了CPU效率，不易提供多作业环境。 适用：延时时间较短、重复次数有限的情况。 2.硬件定时 方法：利用专门的定时/计数器作为主要硬件，在简单软件控制下，产生准确时间延迟。 优点：定时/计数器与CPU并行工作，不占CPU时间，利用定时/计数器产生中断信号，可以建立多作业环境，大大提高了CPU利用率。 适用：广泛应用。 8253／8254是Intel公司生产的一种通用的计数／定时器CTC，也称为可编程序间隔定时器PIT，它是采用NMOS工艺由单一+5V电源供电的双列直插式封装24引脚芯片。8253／8254芯片两者的外形引脚及功能都是兼容的，仅是工作的最高频率有所不同，以满足不同的接口要求。例如： 8253 (2MHz)、 8253-5 (5MHz )， 8254 (8MHz)、 8254-5 (5MHz )、 8254-2 (10MHz)。 8.1.1 8253的结构及功能 1. 8253的引脚 图8.1 8253引脚及功能结构 8253 1 24 2 23 3 22 4 21 5 20 6 19 7 18 8 17 9 16 10 15 11 14 12 13 D 7 CLK 0 OUT 0 GATE 0 GND OUT 1 V CC A 1 CLK 2 OUT 2 GATE 2 CLK 1 GATE 1 D 6 D 5 D 4 D 3 D 2 D 1 D 0 WR RD CS A 0 0 # 8253 D 7 ～D 0 A 0 CLK 0 GATE 0 OUT 0 CLK 1 GATE 1 OUT 1 CLK 2 GATE 2 OUT 2 WR RD A 1 CS 1 # 2 # 2. 8253内部结构 (1) 数据总线缓冲器 是8253用于和CPU数据总线连接的8位、双向、三态缓冲器，CPU读写8253的所有数据都经过该缓冲器。 ◎ CPU用输出指令向8253写入方式控制字至控制寄存器、写入计数值至某个计数器，都是经数据总线缓冲器和8253内部总线传送的。 ◎ CPU用输入指令读某个计数器值时，该计数器的现行计数值经8253内部总线和数据总线缓冲器传送到系统数据总线上，读入CPU。 (2) 读/写逻辑 是8253内部操作的控制部件 ◎ 接收系统总线输入信号，转换成8253内部操作的各种控制信号 ◎ 选择读写操作的对象（某计数器或控制寄存器－由A0、A1决定） ◎ 决定内部总线上数据的传送方向（输入还是输出—由WR、RD决定） 8253端口地址及内部操作 (3) 控制寄存器 ◎ 8253初始化时接收CPU写入的控制字 ◎ 控制字指定计数器的工作方式，选择以二进制或二—十进制计数等 ◎ 该寄存器为只写寄存器 (4) 计数器0、计数器1、计数器2 ◎ 三个计数器结构完全相同、操作完全独立 ◎ 每个计数器内部包含：一个16位计数初值寄存器（CR）、计数执行部件（CE）、一个16位输出锁存器 （OL）和一个控制寄存器 ◎ 每个计数器外部有两个输入端（CLK、GATE）和一个输出端（OUT） 3. 计数器的内部结构 计数器 0 控制寄存器 计数初值寄存器(CR) 减1计数器(CE) 输出锁存寄存器(OL) CRH CEH OLH CRL CEL OLL 4. 8253的工作过程 (1) 由CPU向控制寄存器写入控制字，以确定工作方式； (2) 由CPU向计数器寄存器写入计数初值或定时常数； (3) 计数单元从计数器寄存器中获得初值，在CLK端输入的计数脉冲控制下进行减1计数（CLK决定计数速率）； (4) 减到0时，该状态由OUT输出或由状态寄存器的某一位表示，以作为中断请求信号或供查询方式使用，也可将OUT 连到一个I/O设备上，去启动一个I/O操作； (5) 任何时候都可以将计数单元的当前值送到输出锁存器被CPU读取而不干扰计数器继续计数； (6) 门脉冲GATE是由设备送来的，作为对时钟脉冲的控制