verilog验个程序.docVIP

  • 4
  • 0
  • 约5.9万字
  • 约 73页
  • 2018-11-15 发布于江苏
  • 举报
verilog验个程序

3-8 译码器 //学习3 8译码器的原理, //拨码开关的 1 2 3作为输入 //本实验采用拨码开关来作为输入,LED作为状态显示 //当然如果你的学习板没有拨码开关,可以用key1 key2 key3 作为数据输入。 //视频教程适合我们21EDA电子的所有学习板 module decoder_38(out,key_in); output[7:0] out; //3 8译码器输出有8钟状态,所以要8个LED灯。 input[2:0] key_in; //(1 2 3)key1 key2 key3 作为数据输入 reg[7:0] out; always @(key_in) begin case(key_in) 3d0: out=8 //LED作为状态显示,低电平有效 3d1: out=8 3d2: out=8 3d3: out=8 3d4: out=8 3d5: out=8 3d6: out=8 3d7: out=8 endcase end endmodule 1位数码管动态显示 //一位数码管试验 //利用分频计数器得到数码管,效果 //视频教程

文档评论(0)

1亿VIP精品文档

相关文档