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计数器实验报告.pdfVIP

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  • 2019-06-30 发布于四川
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计数器实验报告.pdf

    数字逻辑与处理器基础 实验一 计数器 实验报告 实验目的： 1 掌握简单时序逻辑电路的设计方法； 2 了解任意进制计数器的设计方法 实验工具： 1 Verilog 语言 2 Quartus II 9.0 3 DE2 实验板 实验设计： 1 同步计数器 (1)设计思路 设计的基本思路就是用四个寄存器充当四位输出qa,qb,qc,qd。由于是同步计数，四个 寄存器由同一个时钟信号clk 控制，当时钟信号由高到低翻转时，最低位qa 进行翻转，同 时进行条

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