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课程实验报告 2012--2013学年（一）学期 　　实验名称：数字钟的设计 　　专业班级：10机制3 　　学生姓名：陈远 　　学 号：20100615341 　　任课教师：朱雷平 　　数字钟的设计 　　一、实验目的 　　1：熟悉集成电路的引脚安排 　　2：掌握74290芯片的引脚功能和使用方法 　　3：了解数字钟的组成及工作原理 　　4：熟悉数字钟的设计与制作 　　二、设计内容 　　设计一个数字钟电路，要求其具有下列功能 　　1：时，分计数和现实 　　2：时采用二十四进制，分采用六十进制 　　三、实验方式 　　1：通过ewb软件设计电路并仿真，确认电路正确2：在实验室进行实物连接 四、设计电路图 　　1.用两片74LS290连成六十进制电路，六十进制计数器由2位组成，个位（1）为十进制，十位（2）为六进制，电路连接如图所示，个位的最高位QD连接到十位的CLKA端。 　　个位十进制计数器经过十个脉冲循环一次，每当第十个脉冲来到时，QD由1变为0，相当于一个下降沿，使十位六进制计数器计数。个位计数器经过第一个十脉冲，十位计数器计数为0001；经过二十个脉冲，计数为0010；以此类推，经过六十脉冲，计数为0110.接着，立即清零，个位和十位都恢复为0000.这就是六十进制计数器。 　　2.用两片74LS290,74LS00，74LS04连成二十四进制电路。二十四进制计数器有两位组成，电路连接如图所示。个位的最高位QC连到十位的CLKA端。 　　十位和个位一开始计数都为0000，当个位的十进制计数器记到1001时，十位二进制计数为0001，此时，个位计数器立即清零。以此循环，直至十位计数到0010，个位计数到0100时。接着，立即清零，个位和十位计数器都恢复到0000.这就是二十四进制计数器。 　　3.六十进制的脉冲用连续脉冲自动实现，二十四进制的脉冲由六十进制提供。 　　五、总结 　　数字钟实验是一个规模相对较大的工程，同时包含了组合逻辑电路和时序逻辑电路，使用的芯片数量大。做实验之前一定要先规划好整体布局，将各个不同功能的模块，有序的排列在面包板上，合理使用与非门、或非门，使得连接所需的导线尽可能短。设计过程应充分运用先整体后部分、自顶向下的设计方式，实现各个模块功能，最后测试整个电路的功能。还要增强相应的电路调试能力，现实测试中会出现各种之前想象不到的状况，要能分析故障原因，获取同学和老师帮助。 　　总体来说，此次设计立足于数字电路技术，在实践中加强的自己对理论的理解。通过搜集资料，拟定方案、同学讨论、系统规划等手段，终于完成了任务要求。我深刻体会到理论与实践相联系的重要性，通过实践使自己的专业知识更加结构化、系统化。