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dac8562中文引脚定义
名称
引脚
描述
AVDD
9
供电2.7-5.5V
/CLR
5
异步清零输入，在下降沿清零所有寄存器，24个跳变沿后退出该模式。在该模式中输入被禁止。
(根据手册第一页下图理解，该引脚就是寄存器清零控制端，在命令寄存器中有此功能，所以电路中改引脚接高电平)
Din
8
SPI 24位数据输入口。
GND
3
/LDAC
4
在同步模式下，数据与24个下降沿更新SCLK周期，如下一个下降边缘同步。这种同步更新，LDAC引脚是不需要的，它必须连接到接地或永久性的断言和举行低之前，发送命令到设备。
在异步模式下，LDAC引脚是用来作为一个负边沿触发定时信号同步DAC的更新。多个单通道命令可以写为设置不同的通道缓冲器所需的值，然后在LDAC引脚下降沿同时更新DAC输出寄存器。（来自网页翻译）
(根据手册第一页下图理解，该引脚就是缓存器更新控制端，在命令寄存器中有此功能，所以电路中改引脚接地)
SCLK
7
SPI 信号输入，最大到50MHz
/SYNC
6
级别触发控制输入（低电平）。这个输入是输入的数据帧同步信号。当同步变低，它使输入移位寄存器，并在随后的下降时钟采样数据边缘。DAC输出更新后的24时钟的下降沿。如果是采取同步高前23时钟的上升沿同步边缘，作为中断，和写序列被忽略dac756x?/?dac816x?/?dac856x.schmitt-trigger逻辑输入
VOUT1
1
A路输出
VOUT2
2
B路输出
VREF
参考电压输入或2.5V参考电压输出
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