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微机原理与接口技术（楼顺天第二版）习题解答 第6章 总线及其形成 6.1答：内存储器按其工作方式的不同，可以分为随机存取存储器（简称随机存储器或RAM）和只读存储器（简称ROM）。 随机存储器。随机存储器允许随机的按任意指定地址向内存单元存入或从该单元取出信息，对任一地址的存取时间都是相同的。由于信息是通过电信号写入存储器的，所以断电时RAM中的信息就会消失。计算机工作时使用的程序和数据等都存储在RAM中，如果对程序或数据进行了修改之后，应该将它存储到外存储器中，否则关机后信息将丢失。通常所说的内存大小就是指RAM的大小，一般以KB或MB为单位。 只读存储器。只读存储器是只能读出而不能随意写入信息的存储器。ROM中的内容是由厂家制造时用特殊方法写入的，或者要利用特殊的写入器才能写入。当计算机断电后，ROM中的信息不会丢失。当计算机重新被加电后，其中的信息保持原来的不变，仍可被读出。ROM适宜存放计算机启动的引导程序、启动后的检测程序、系统最基本的输入输出程序、时钟控制程序以及计算机的系统配置和磁盘参数等重要信息。 6.2 答：存储器的主要技术指标有：存储容量、读写速度、非易失性、可靠性等。 6.3 答：在选择存储器芯片时应注意是否与微处理器的总线周期时序匹配。作为一种保守的估计，在存储器芯片的手册中可以查得最小读出周期tcyc(R)(Read Cycle Time)和最小写周期tcyc(W)(Write Cycle Time)。如果根据计算，微处理器对存储器的读写周期都比存储器芯片手册中的最小读写周期大，那么我们认为该存储器芯片是符合要求的，否则要另选速度更高的存储器芯片。 8086CPU对存储器的读写周期需要4个时钟周期(一个基本的总线周期)。因此，作为一种保守的工程估计，存储器芯片的最小读出时间应满足如下表达式： tcyc(R)＜4T－tda－tD－T 其中：T为8086微处理器的时钟周期；tda为8086微处理器的地址总线延时时间；tD为各种因素引起的总线附加延时。这里的tD应该认为是总线长度、附加逻辑电路、总线驱动器等引起的延时时间总和。 同理，存储器芯片的最小写入时间应满足如下表达式： tcyc(W)＜4T－tda―tD―T 6.4 答：全地址译码、部分地址译码和线选。全地址译码方式下CPU地址总线的所有地址均参与存储单元的地址译码，存储单元地址唯一；部分地址译码方式和线选方式下CPU地址总线的有一些地址信号没有参与译码，则取0或取1均可，所以存储器的存储单元地址不唯一，有重复。 6.5 答：数据总线的低8位接偶存储体，高8位接奇存储体；地址总线的A19~A1同时对奇偶存储体寻址，地址总线的A0只与偶地址存储体连接，与奇地址存储体连接。 6.6 答：(1)1k×1 片，片内寻址：，共10位；片选控制信号：，共6位。 (2)1k×4 片，片内寻址：，共10位； 片选控制信号：，共6位。 (3)4k×8 片，片内寻址：，共12位； 片选控制信号：，共4位。 (4)16k×4 片，片内寻址：，共14位； 片选控制信号：，共2位。 6.7 答：(1)1k×1 片，片内寻址：，共10位； 片选控制信号：，共10位。 (2)1k×4 片，片内寻址：，共10位； 片选控制信号：，共10位。 (3)4k×8 片，片内寻址：，共12位； 片选控制信号：，共8位。 (4)16k×4 片，片内寻址：，共14位； 片选控制信号：，共6位。 6.8 答：32K==8000H，所以，最高地址为：4000H+8000H-1=BFFFH，则，可用的最高地址为0BFFFH. 6.9 答：7FFFH-4000H+1=4000H==16KB，内存容量为16KB。 6.10 答：因为6264的片容量为8KB。RAM存储区域的总容量为03FFFH-00000H+1=4000H=16KB，故需要2片6264芯片。连接图如图6.10所示。 图6.10 与8088系统总线的连接图 检测程序段： MOV AX,0000H MOV DS,AX MOV SI,0 MOV CX,16*1024 MOV AL,55H CMPL: MOV [SI],AL MOV BL,[SI] CMP BL,AL JNE ERROR INC SI LOOP CMPL MOV DL,0EEH JMP NEXT ERROR: MOV DL,01H NEXT: … 6.11 答：EPROM芯片的编程有两种方式：标准编程和快速编程。 在标准编程方式下，每给出一个编程负脉冲就写入一个字节的数据。Vpp上加编程电压，地址线、数据线上给出要编程单元的地址及其数据，并使=0,=1。上述信号稳定后，在端加上宽度为50ms±5ms的负脉