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9. N个触发器可以构成能寄存（ ）位二进制数码的寄存器。 A.N-1 B.N C.N+1 D.2N 10. 8位移位寄存器，串行输入时经（ ）个脉冲后，8位数码全部移入寄存器中。 A.1 B.2 C.4 D.8 11. 判断图题所示电路为何种计数器（ ）。 A.异步二进制减法 B.同步二进制减法 C.异步二进制加法 D.同步二进制加法 B D A 12. 用二进制异步计数器从0做加法，计到十进制数178， 则最少需要（ ）个触发器。 A.6 B.7 C.8 D.10 13. 某数字钟需要一个分频器将32768HZ的脉冲转换为1HZ 的脉冲，欲构成此分频器至少需要（ ）个触发器。 A.10 B.15 C.32 D.32768 14. 判断图题所示电路为何种计数器（ ）。 A.异步二进制减法 B.同步二进制减法 C.异步二进制加法 D.同步二进制加法 C B A 15. 判断图题所示电路为何种计数器（ ）。 A.异步二进制减法 B.同步二进制减法 C.异步二进制加法 D.同步二进制加法 16. 一位8421BCD码计数器至少需要（ ）个触发器。 A.3 B.4 C.5 D.10 17. 同步计数器和异步计数器比较，同步计数器的显著 优点是（ ）。 A.工作速度高 B.触发器利用率高 C.电路简单 D.不受时钟CP控制。 C B A 18. 欲设计0，1，2，3，4，5，6，7这几个数的计数器，如果设计合理，采用同步二进制计数器，最少应使用（ ）级触发器。 A.2 B.3 C.4 D.8 19. 图题所示74HC161计数器电路的模是（ ）。 A.7 B.8 C.9 D.10 B D 20. 把一个五进制计数器与一个四进制计数器串联可得到（ ）进制计数器。 A.4 B.5 C.9 D.20 21. 判断图题所示电路为（ ）计数器。 A.异步二进制减法 B.同步二进制减法 C.异步二进制加法 D.同步二进制加法 D D 四、计算分析 1.已知图所示单向移位寄存器的CP及输入波形如图所示，试画出Q0、Q1、Q2、Q3波形（设各触发初态均为0）。 4. 利用集成计数器构成图所示两个电路，试分析各电路为几进制计数器？并画出状态转换图。 a)为13进制计数器 b)为50进制计数器 状态转换图（略） 5.图是利用74HC163构成的N进制计数器，请分析其为几进制计数器？ 60进制计数器 10.已知一天有24小时，试利用74HC160设计一个二十四进制计数器。 一、填空题 1. 某单稳态触发器在无外触发信号时输出为0态，在外加触发信号时，输出跳变为1态，因此，其稳态为 态，暂稳态为 态, 暂稳态所处时间的长短取决于电路本身 的参数。 2. 单稳态触发器在数字系统中应用很广泛，通常用于脉冲信号的 、 及 。 3. 单稳态触发器有 ____ 个稳定状态；多谐振荡器有 ____ 个稳定状态。 4. 占空比q 是指矩形波 持续时间与其 之比。 0 1 第六章 脉冲信号的产生与转換 0 1 高电平 周期 展宽 延时 整形 定时元件 5. 触发器能将缓慢变化的非矩形脉冲变换成边沿陡峭的矩形脉冲。 6. 施密特触发器有 个阀值电压，分别称作 和 。 7. 555定时器型号的最后数码为555的是 产品，为7555的是 产品。 8. 为了实现高的频率稳定度，常采用 振荡器；单稳态触发器受到外触