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Exploiting Instruction
Level Parallelism with Software
Approaches
4.1~4.4
1
ZJU_Computer Architecture_pipelining_SQS
Topics
4.1 Basic Compiler Techniques for Exposing ILP
4.2 Static Multiple Issue: the VLIW Approach(4.3)
4.3 Advanced Compiler Support for Exposing and
Exploiting ILP(4.4 )
(Dependence and Advanced Compile )
4.4 Hardware Support for Exposing More Parallelism at
Compile-Time(4.5)
2
ZJU_Computer Architecture_pipelining_SQS
4.1 Basic Compiler Techniques for Exposing ILP
4.1.1 流水线调度
• 流水线调度：若j指令要用到i指令的结果(RAW相关
)，流水线调度是指把（i和j)两条指令分隔开来，两者之
间应间隔的时钟周期数等于源指令产生结果所需的延时
(latency)时钟周期数。
• 两种流水线调度方法
– Static pipeline scheduling by compiler(Ch. 4)
– Dynamic pipeline scheduling by hardware(Ch. 3)
3
ZJU_Computer Architecture_pipelining_SQS
Assumptions
• 本章采用如下假设
– 无结构竞争 (即有足够硬件可供使用),每一时钟周期可发
射一条指令
– 采用MIPS标准的整数操作流水线结构 (即由
IF,ID,EX,MEM,WB五拍组成)
– 转移指令(Branch)后有一个时钟周期延时
– 浮点操作的延时时钟周期数参见下表
Instr. Producing result Instr. Using result Latency in CC
FP ALU op Another FP ALU op 3
FP ALU op Store double 2
Load double FP ALU op 1
Load double Store double 0
4
ZJU_Computer Architecture_pipelining_SQS
4.1.
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