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MIPS 体系结构介绍 张福新 MIPS CPU的发展 MIPS I 1987 MIPS R2000(16MHZ) 1990 MIPS R3000(33MHZ) 1990 IDT R3051(20MHZ) MIPS III 1991 MIPS R4000 (100MHZ) 1993 IDT/QED R4600(100MHZ) 1993 MIPS R4400(150MHZ) 1995 NEC/MIPS Vr4300(133MHZ) MIPS IV 1996 MIPS R10000 (200MHZ) 1996 SGI/QED R5000(200MHZ) MIPS 体系结构特点(1) 定长指令(32bit) 32个通用寄存器(寄存器0恒为0) 三操作指令格式(两个源一个目标) 无条件码 只有load/store指令访存 单一寻址模式 Load/store要求对齐 跳转指令范围限制: 绝对跳转256M，相对跳转128K 乘除法专用hi,lo寄存器 MIPS 体系结构特点(2) 没有字节或者半字运算指令 没有特殊的栈支持 ABI 最小化的过程调用支持 跳转并联接指令 jal,jalr 最简化的中断和例外处理支持 EPC,CAUSE寄存器，特定入口 软件处理上下文保存和mmu管理 和流水线实现相关的一些特点 延迟槽: delayed branch和load delay slot 乘除法部件的