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STEP1 ：建立 工作库文件夹 STEP2 ：输入设计项目 原理图 /VHDL 文本代码 STEP3 ：存盘，注意 原理图 / 文本取名 STEP4 ：创建 Project STEP11 ： 硬件测试 STEP9 ：引脚 锁定并编译 STEP8 ：仿真测 试和波形分析 STEP7 ：建立仿 真波形文件 STEP6 ： 启动编译 STEP10 ：编程 下载 / 配置 基本设计流程 为设计全加器 新建一个文 件夹作工作库 文件夹名取为 My_prjct 注意，不可 用中文！ 返回目录 1 工作 库文 件夹 2 创建工程 返回目录 创建一个新的工程 路径必须是英文！！ 返回目录 返回目录 返回目录 建立新的输入文件 返回目录 查 找 匹 配 定 界 符 增 加 缩 进 减 小 缩 进 跳 到 书 签 位 置 设 置 书 签 删 除 书 签 插 入 分 页 符 插 入 文 件 分 析 当 前 文 件 插 入 模 板 显 示 行 编 号 显 示 连 续 标 记 “/” VHDL 语 言 AHDL 语 言 V erilog HDL 语 言 综合编译 Timing 换为 Fu