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4选1数据选择器实例
4选1数据选择器实例1
out
sel(1) sel(0) out
0 0 in0 sel(1)
MUX
0 1 in1 sel(0)
1 0 in2
in0 in1 in2 in3
1 1 in3
4选1数据选择器实例1
module mux4_1(out,in0,in1,in2,in3,sel); 矢量类型
output out;
input in0,in1,in2,in3;
case (表达式)
input[1:0] sel; 选项值1: 语句1；
reg out; 选项值2: 语句2 ；
选项值3: 语句3 ；
always @(in0 or in1 or in2 or in3 or sel) …
case(sel) default: 缺省语句
endcase
2b00: out=in0;
2b01: out=in1;
位长度 进制符号数字及a到f （十六进制）
2b10: out=in2;
2b11: out=in3; sel(1) sel(0) out
0 0 in0
default: out=1bx;
0 1 in1
endcase
1 0 in2
endmodule
1 1 in3
Verilog 中数的表示方法
位长度 进制符号数字及a到f （十六进制）
3 b101 //3位二进制数
5 D 3 //5位十进制数
12 h x //12位不确定数
16 o z //16位高阻态
16 b 1001_0110_1111_zzzz //16位二进制数
h 123F //无位长度的十六进制数
o 123 //无位长度的八进制数
4选1数据选择器实例2
module mux4_1(out,in0,in1,in2,in3,sel);
o
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