加法器数电实验报告三.docx

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2020-09-13 发布于天津
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实验三加法器一实验目的掌握用器件实现全加器的方法掌握用组合逻辑器件实现全加器的方法掌握集成加法器的应用二实验设备及器件数字逻辑电路实验板块四二输入与非门片四二输入异或门片双四选一数据选择器片位二进制全加器片三实验原理组合逻辑电路是数字电路中最常见的逻辑电路之一组合逻辑电路的特点就是在任意时刻电路的输出仅取决于该时刻的输入信号而与信号作用前电路所处的状态无关本实验是根据给定的逻辑功能设计出实现这些功能的组合逻辑电路不考虑低位进位只本位相加称半加实现半加的电路为半加器考虑低位进位的加法称为全加实现全

实验三加法器一、实验目的 1、掌握用SSI器件实现全加器的方法。 2、掌握用MS组合逻辑器件实现全加器的方法。 3、掌握集成加法器的应用。二、实验设备及器件 1、数字逻辑电路实验板1块 TOC \o 1-5 \h \z 2、 74HC（LS）00 （四二输入与非门） 1片 3、 74HC（LS）86 （四二输入异或门） 1片 4、 74HC（LS）153 （双四选一数据选择器） 1片 5、 74HC（LS）283（ 4位二进制全加器）1片三、实验原理组合逻辑电路是数字电路中最常见的逻辑电路之一。组合逻辑电路的特点，就是在任意时刻电路的输出仅取决于该时刻的输入信号，