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模块15 时序逻辑电路; 电路的输出状态不仅取决于当时的输入信号，而且与电路原来的状态有关。;15.1 触发器;15.1.1 基本 RS 触发器
; 触发器输出与输入的逻辑关系 ;设原态为 0 态;0;设原态为 1 态;1;设原态为 1 态;1;基本 RS 触发器状态表;S;15.1.2. 钟控RS 触发器;当CP=0时;当 CP = 1 时;当 CP = 1 时;1;1;钟控RS触发器逻辑状态表;画出钟控RS 触发器的输出波形;基本RS触发器;15.1.4 JK触发器;1;1;1;1;;存在问题1：;;D 触发器工作波形图;JK 触发器工作波形;74LS112双JK触发器;15.1.6 触发器逻辑功能的转换;2. 将JK触发器转换为 T 触发器;15.2 寄存器;15.2 寄存器;15.2 寄存器;作业：[练15.2]、[练15.3]
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