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- 2021-11-03 发布于广东
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Verilog教程清华微电所;提纲;Verilog概述
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夏宇闻,北京航空航天大学出版社;模块(module);模块;时延;数据流描述方式;行为描述方式;行为描述方式;结构化描述方式;设计模拟;设计模拟;设计模拟;标识符;注释;编译指令;`include;`timescale;Verilog概述
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