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用同步 JK触发器设计一个六进制的计数器
一、 实验目的：利用若干个同步 JK触发器和逻辑门设计六进制的计
数器并用数码管显示计数值。
二、实验原理：
状态转换图：
由于 468，因此用三片 JK触发器，利用 0~5 循环，
卡诺图：
Q2Q1 00 01 11 10
Q3/0 001 010 100 011
Q3/1 101 000 *** ***
Q1 卡诺图
Q1Q2 00 01 11 10
Q3/0 1 0 0 1
Q3/1 1 0 * *
Q2 的卡诺图
Q1Q2 00 01 11 10
Q3/0 0 1 0 1
Q3/1 0 0 * *
Q3 的卡诺图
Q1Q2 00 01 11 10
Q3/0 0 0 1 0
Q3/1 1 0 * *
状态方程：
Q3*=Q2Q1+Q3Q1’
Q2*=Q3Q2’Q1+Q2Q1’
Q1*=Q1’
驱动方程：
J3=Q2Q1 K3=Q1
J2=Q3’Q1 K2=Q1
J1=1 K1=1.
电 路 图 ：
实验结论：将 JK 触发器与必要的逻辑门组成组成的电路，可以设计
成六进制，在化简卡诺图时，需要注意将无关项设置成有效项中，再
检查电路是否是自启动电路。
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