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- 2022-04-26 发布于北京
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13-95. 图(a)所示电路中,复位信号 、信号A 及时钟脉冲信号如图(b)所示,经分析可知,
在第一个和第二个时钟脉冲的下降沿时刻,输入分别等于:( )。
附:触发器的逻辑状态表为:
D +1
0 0
1 1
(A)0,0 (B)0,1 (C )1,0 (D )1,1
13-96. 图(a)所示电路中,复位信号、数据输入及时钟脉冲信号如图(b)所示,经分析可知,在第
一个和第二个时钟脉冲的下降沿过后,输入分别等于:( )。
附:触发器的逻辑状态表为:
J K +1
0 0
0 1 0
1 0
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