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CACHE 接入系统的体系结构 侧接法：像入出设备似的连接到总线上，优点是结构简单，成本低，缺点是不利于降低总线占用率。 CPU MEMORY CACHE Bus Master 1 Bus Master 2 总线 CACHE 接入系统的体系结构 隔断法：把原来的总线打断为两段，使 CACHE 处在两段之间。优点是有利于提高总线利用率，支持总线并发操作；缺点是结构复杂，成本较高。 CPU MEMORY Bus Master 1 Bus Master 2 总线 CACHE 本章主要内容 高速缓冲存储器（Cache） 高速缓存的基本运行原理 高速缓存的3种映像方式 高速缓存使用中的几个问题 虚拟存储器 虚拟存储器概述 段式存储管理 页式存储管理 * 计算机原理及系统结构课件 第8章 高速缓冲存储器和虚拟存储器 本章主要内容 高速缓冲存储器（Cache） 高速缓存的基本运行原理 高速缓存的3种映像方式 高速缓存使用中的几个问题 虚拟存储器 虚拟存储器概述 段式存储管理 页式存储管理 微电子技术发展趋势 CPU与DRAM性能比较 P214 程序的局部性原理 程序在一定时间段内通常只访问较小的地址空间 两种局部性：时间局部性和空间局部性 时间局部性：最近被访问的信息很可能还要被访问。 将最近被访问的信息项装入到Cache中。 空间局部性：最近被访问的信息临近的信息也可能被访问。 将