一种基于FPGA的二维多通道卷积硬件加速器.pdfVIP

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2023-05-06 发布于北京
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一种基于FPGA的二维多通道卷积硬件加速器.pdf

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本发明涉及一种基于FPGA的二维多通道卷积硬件加速器，包括：控制单元、偏置缓存、权重缓存、输入特征缓存、卷积缓存、权重预读寄存器组、PE阵列、非线性单元、第二选通器和第三选通器；特征缓存连接PE阵列；权重缓存通过权重预读寄存器组连接PE阵列；偏置缓存与卷积缓存通过第三选通器连接PE阵列，PE阵列输出端通过第二选通器连接卷积缓存和非线性单元；输入特征缓存、偏置缓存和权重缓存加载数据；权重预读寄存器组对权重缓存进行预读寄存；PE阵列写入输入特征、预读寄存的权重数据，偏置数据或卷积中间结果进行卷积运算

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114327629 A (43)申请公布日 2022.04.12 (21)申请号 202111682235.X G06N 3/063 (2006.01) (22)申请日 2