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- 2023-05-18 发布于四川
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本发明公开了一种用于加速存储部件网表仿真的方法、系统及介质,本发明方法包括在子系统的验证环境中,将原来的存储子系统RTL设计整体替换为存储子系统网表;缩减了内存控制器和内存物理接口中与仿真测试程序运行无关的寄存器配置,提高内存控制器和内存物理接口中寄存器配置的时钟频率到物理设计能容忍的最高时钟频率,通过强制赋值的方式对内存控制器和内存物理接口中的寄存器进行单独配置。本发明能够使用原存储子系统的RTL验证环境,可以继承原有的测试用例,沿用原有的正确性检查机制,减少后仿验证环境开发成本;本发明能够缩
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 111427794 A
(43)申请公布日
2020.07.17
(21)申请号 20201
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