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本发明公开了一种具有高电源噪声抑制比的锁相环电路，包括：鉴频鉴相器、电荷泵、环路滤波器和分频器，还包括：自校准频率电路和电源噪声抑制压控振荡器，所述鉴频鉴相器的输出端连接所述电荷泵的输入端；所述电荷泵的输出端连接所述环路滤波器的输入端和所述电源噪声抑制压控振荡器的第一输入端；所述电源噪声抑制压控振荡器的输出端作为电路信号输出端，并连接所述分频器的输入端；所述分频器的输出端输出反馈时钟给所述鉴频鉴相器的一个输入端，所述鉴频鉴相器的另一个输入端接收基准时钟。本发明解决现有抑制电源噪声技术中过多消耗面
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112242841 A
(43)申请公布日 2021.01.19
(21)申请号 202011336536.2
(22)申请日 2020.11.25
(71)申请人 灿芯半导体（苏州）有限公司
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