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提供了处理电路、信息处理设备和信息处理方法。信息处理电路包括加速器功能单元(AFU)、FPGA接口单元(FIU)、标签检查单元以及输出控制单元。AFU顺序地获取针对多种数据的写控制指令，所述写控制指令包括停止后续指令的输出的输出等待指令。FIU经由第一路径或第二路径顺序地输出写控制指令。标签检查单元接收对从FIU输出的写控制指令的响应。输出控制单元基于写控制指令的存储地址选择第一路径和第二路径中的一个，确定混合写控制指令的必要性，混合写控制指令，并且使FIU输出结果。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112214434 A
(43)申请公布日 2021.01.12
(21)申请号 202010646078.6
(22)申请日 2020.07.07
(30)优先权数据
2019-1287
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