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- 2023-06-05 发布于四川
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本发明公开了一种集成电路,包括存储器阵列、多条字线、多条位线以及页面缓冲器。存储器阵列包括多个存储器单元,分别经配置以被写入权重。多条字线分别连接多个存储器单元中的一列存储器单元。多条位线分别连接多个存储器单元的彼此串联连接的一栏存储器单元。多条位线的在存储器阵列的一区块中的多者或多条字线的在存储器阵列的多个区块中的多者经配置以接收多个输入电压,且接收多个输入电压的存储器单元经配置以将写入权重与接收的输入电压相乘。页面缓冲器耦合至存储器阵列,且经配置以感测权重与输入电压的多个乘积。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112750487 A
(43)申请公布日 2021.05.04
(21)申请号 201911067337.3 G06F 7/52 (2006.01)
(22)申请日 20
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