运算电路、半导体装置及电子设备.pdfVIP

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2023-06-17 发布于四川
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运算电路、半导体装置及电子设备.pdf

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提供一种可以抑制信号延迟且并行进行积和运算的半导体装置。本发明是一种包括第一至第四寄存器、加法器、乘法器、选择器及第一存储部的半导体装置。第一寄存器的输出端子与第二寄存器的输入端子电连接，第二寄存器的输出端子与乘法器的第一输入端子电连接。乘法器的输出端子与加法器的第一输入端子电连接，加法器的输出端子与第三寄存器的输入端子电连接。第三寄存器的输出端子与选择器的第一输入端子电连接，选择器的输出端子与第四寄存器的输入端子电连接，第一存储部与乘法器的第二输入端子电连接。第一存储部具有读出对应于输入到第一

(19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114585997 A (43)申请公布日 2022.06.03 (21)申请号 202080073315.2 (74)专利代理机构上海专利商标事务所有限公