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本发明提供一种用于并串转换的装置和芯片。该装置包括：多模分频器，被配置为接收时钟信号，并且根据接收到的时钟信号生成任意分频比的分频时钟信号；移位寄存器，与所述多模分频器电连接，被配置为接收待转换的并行数据和所述分频时钟信号，并且根据所述分频时钟信号将所述并行数据转换为奇数位串行数据和偶数位串行数据；以及预驱动器，与所述移位寄存器电连接，被配置为接收并混合所述奇数位串行数据和所述偶数位串行数据，以生成最终串行数据。本发明的用于并串转换的装置能够支持任意的多种并串转换模式，并且能够支持任意阶数的均衡
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116436470 A
(43)申请公布日 2023.07.14
(21)申请号 202310404891.6
(22)申请日 2023.04.14
(71)申请人 上海壁仞智能科技有限公司
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