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2023年安康职业技术学院计算机应用技术专业《计算机组成原理》科目期末试卷B（有答案） 一、选择题 1、某一计算机采用主存Cache存储层次结构，主存容量有8个块，Cache容量有4个块，采取直接映射方式。若主存块地址流为0，1，2，5，4，6，4，7，1，2，4，1，3，7，2，一开始Cache为空，此期间Cache的命中率为（ ）。 A.13.3% B.20% C.26.7% D.33.3% 2、采用八体并行低位交叉存储器，设每个体的存储容量为32K×16位，存储周期为400ns，下述说法中正确的是（ ）。 A.在400ns内，存储器可向CPU提供2位二进制信息 B.在l00ns内，每个体可向CPU提供27位二进制信息 C.在400ns内，存储器可向CPU提供2位二进制信息 D.在100ns内，每个体可向CPU提供2位二进制信息 3、下列描述中，正确的是（ ）。 A.控制器能理解、解释并执行所有指令以及存储结果 B.所有数据运算都在CPU的控制器中完成 C.ALU可存放运算结果 D.输入、输出装置以及外界的辅助存储器称为外部设备 4、假定编译器对高级语言的某条语句可以编译生成两种不同的指令序列，A、B和C三类指令的CPl和执行两种不同序列所含的三类指令条数见下表。则以下结论错误的是（）。 I.序列一比序列二少l条指令 Ⅱ.序列一比序列二的执行速度快 Ⅲ.序列一的总时钟周期数比序列二多1个 Ⅳ.序列一的CPI比序列二的CPI大 A.I、ll B.1、Ⅲ C. ll、1V D.Ⅱ 5、CPU中的译码器要用（ ）。 A.地址译码人 B.指令译码 C.数据译码1 D.控制信号译码 6、某同步总线采用数据线和地址线复用方式，其中地址/数据线有32根，总线时钟频率为66MHz，每个时钟周期传送两次数据（上升沿和下降沿各传送一次数据），该总线的最大数据传输率（总线带宽）是（ ）。 A.132MB/s B.264MB/s C.528MB/s D.1056MB/s 7、总线的通信控制主要解决（ ）问题。 A.由哪个主设备占用总线 B.通信双方如何获知传输开始和结束 C.通信过程中双方如何协调配合 D.B和C 8、指令从流水线开始建立时执行，设指令由取指、分析、执行3个子部件完成，并且，每个子部件的时间均为At，若采用常规标量单流水线处理器（即处理器的度为1），连续执行12条指令，共需（ ）。 Α.12Δt B.14Δt C.16Δt D.18Δt 9、微指令操作控制字段的每一位代表一个控制信号，这种微程序的控制方式叫作（ ） A.字段直接编码 B.字段间接编码 C.混合编码 D.直接编码 10、某计算机系统中，假定硬盘以中断方式与处理器进行数据输入/输出，以16位为传输单位，传输率为50KB/s，每次传输的开销（包括中断）为100个CPU时钟，处理器的主频为50MHz，请问硬盘数据传送时占处理器时间的比例是（ ）。 A.10% B.56.8% C.5% D.50% 11、依赖硬件的数据传送方式是（ ）。 A.程序控制 B.程序中断 C.DMA D.无 12、关于浮点数在IEEE754标准中的规定，下列说法中错误的是（ ）。 I.浮点数可以表示正无穷大和负无穷大两个值 Ⅱ.如果需要，也允许使用非格式化的浮点数 Ⅲ.对任何形式的浮点数都要求使用隐藏位技术 IⅣ.对32位浮点数的阶码采用了偏移值为l27的移码表示，尾数用原码表示 13、组成一个运算器需要多个部件，但下面所列（ ）不是组成运算器的部件。 A.通用寄存器组 B.数据总线 C.ALU D.地址寄存器 14、零地址双操作数指令不需要指出操作数地址，这是因为（ ）。 A.操作数已在数据缓冲寄存器中 B.操作数隐含在累加器中 C.操作数地址隐含在堆栈指针中 D.利用上一条指令的运算结果进行操作 15、寄存器间接寻址方式中，操作数在（ ）中。 A.通用寄存器 B.堆栈 C.主存单元 D.指令本身 二、填空题 16、寻址方式按操作数的物理位置不同，多使用_______型和_______型，前者比后者执行速度快。 17、对存储器的要求是________、________、________为了解决这三个方面的矛盾。计算机采用多级存储器体系结构。 18、存储器的技术指标有存储容量、存取时间、________和________、 19、形成指令寻址的方式，称