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RAM32X2SR
RAM32X2S
Primitive:32-Deepby2-WideStaticSynchronousRAM
RAM32X2SRAM32X2Sisa32-wordby2-bitstaticrandomaccessmemorywithsynchronous
WEO0writecapability.Whenthewriteenable(WE)isLow,transitionsonthewriteclock
D0
O1
D1(WCLK)areignoredanddatastoredintheRAMisnotaffected.When(WE)isHigh,
WLKanypositivetransitionon(WCLK)loadsthedataonthedatainput(D1–D0)intothe
A0wordselectedbythe5-bitaddress(A4–A0).Forpredictableperformance,address
A1anddatainputsmustbestablebeforeaLow-to-High(WCLK)transition.ThisRAM
A2blockassumesanactive-High(WCLK).However,(WCLK)canbeactive-Highor
A3
A4active-Low.Anyinvertercedonthe(WCLK)inpuisabsorbedintotheblock.
Thesignaloutputonthedataoutputpins(O1–O0)isthedatathatisstoredinthe
X4947RAMatthelocationdefinedbythevaluesontheaddresspins.
ForSpartan-3A,youcanusetheINIT_00andINIT_01propertiestospecifytheinitial
contentsofRAM32X2Sasdescribedin“SpecifyingInitialContentsofaSpartan-3A
WideRAM”intheRAM16X2Ssection.
Modeselectionisshowninthefollowingtruthtable:
InputsOutputs
WE(mode)WCLK
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