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基于DSP的数字图像处理系统的设计与实现
文：杨文胜李梅时间：2023-10-717:20:49
安徽广电信息网络有限责任企业阜阳分企业
摘要：为满足高数据量图像处理需求，提出并设计了以TMS320DM642为处理器的数字图像处理硬
件系统，并在DSP/BIOS上配以实时图像处理软件系统，实现数字图像处理。本文论述了系统模块的构成、
软件系统的设计，在此平台上，采集图像并运用优化算法对图像进行增强、分割、边缘检测，成果表明系统
运行正常。
关键词：TMS320DM642图像处理DSP
一、引言
伴随计算机科学技术发展和有关理论的不停完善，数字图像处理技术被广泛应用于可视、电视会
议、监控系统、商用及工业生产领域中。在技术规定中，一种突出的问题就是数据量庞大、数据处理有关性
高、实现实时比较困难。而实时性的重要原因为图像处理的速度，即规定数字图像处理系统要有强大的运算
能力。高性能DSP的发展为实时的图像处理提供了一种处理措施。高速DSP不仅可以满足在运算性能方面
的需要，并且由于DSP的可编程性，还可以在硬件一级获得系统设计的极大灵活性。
行运算单元，处理能力达4800MIPS;采用二级缓存构造，具有64位外接存储器接口，兼容JTAG边界扫描，
为了面向多媒体应用，还集成了3个可配置的视频端口。采用DM642为关键设计的数字图像处理系统，可以
很好的满足图像处理规定。
二、系统硬件平台框架
系统的整体硬件框图如图1所示，整个系统是以TMS320DM642为关键构成的应用系统。包括DM642处理器
芯片、视频编解码器芯片、其他外围电路。DM642通过I2C总线对视频编解码器进行配置，使其可以满足系
统的需求；通过VP口接受和传送视频数据以及同步控制信号；通过EMIF总线实现外部存储器的扩展，
SDRAM用于运行时的程序代码和数据的存储，FLASH用于系统引导程序的存储。
Video
DecoderFPGAFLASHSDRAM
1L1L1C
TMS320DM642
Video
EneoderJTAGCLOCKPOWER
图1系统硬件构成框图
时钟模块方面，片内PLL输入时钟和EMIF外部输入时钟是DM642的两个重要时钟，为保证时钟的
主频。EMIF外部输入时钟为100MHz,此时钟由ICS512芯片提供。
信号都在时钟信号的上升沿触发),与系统时钟同步运行。芯片内存颗粒的构架为1M×32×4banks,每个bank
的行地址数目为12,列地址数目为8。DM642仅支持8位的ROM启动，因此本系统选用了8位数据线宽的
协处理器FPGA与DM642数据线、地址线以及时钟信号线相连，为Flash提供2个分页信号。同步协
处理器模块具有独立的供电模块和配置模块，以及仿真和程序烧写的端口，使系统具有硬件功能扩展性。
视频模块重要实现视频捕捉和显示功能，即实现视频信息的编解码，如图2所示。
VideoCaptureDM642VideoDisplay
图2视频模块框图
视频捕捉模块中，DM642视频端口VP0和VP1与两片视频解码芯片TVP5150相连，实现视频捕捉功
两个复合视频或一种S端输入，输出格式为ITU-RBT.656,使用TI专有技术锁住弱、嘈杂以及不稳定信号。
视频捕捉模块电路原理图如图3所示。
WC3.3VANDEC
WOC3,30ENC
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