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- 2024-04-21 发布于湖北
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第三章组合逻辑电路
第一节重点与难点
一、重点：
1.组合电路基本概念
组合电路信号特点、电路构造特点以及逻辑功能特点。
2.组合电路分析与设计
组合电路分析是依照已知逻辑图阐明电路实现逻辑功能。
组合电路设计是依照给定设计规定及选用器件进行设计，画出逻辑图。如果选用小规模集成电路SSI，设计办法比较规范且容易理解，用SSI设计是读者应掌握最基本设计办法。由于设计电路由门电路构成，因此使用门数量较多，集成度低。
若用中规模集成电路MSI进行设计，没有固定规则，办法较灵活。
无论是用SSI或MSI设计电路，核心是将实际设计规定转换为一种逻辑问题，即将文字描述规定变成一种逻辑函数表达式。
3.惯用中规模集成电路应用
惯用中规模集成电路有加法器、比较器、编码器、译码器、数据选取器和数据分派器等，重要是理解外部引脚功能，能在电路设计时灵活应用。
4.竞争冒险现象
竞争冒险现象产生因素、判断与否存在竞争冒险现象以及如何消除。
二、难点：
1.组合电路设计
无论是用SSI还是用MSI设计电路，一方面遇到是如何将设计规定转换为逻辑问题，得到明确真值表，这一步既是重点又是难点。总结解决这一难点办法如下：
（1）分析设计问题因果关系，分别拟定输入变量、输出变量个数及其名称。
（2）定义逻辑变量0、1信号含义。无论输入变量、输出变量均有两个状态0、1，这两个状态代表含义由设计者自己定义。
（3）再依照设计问题因果关系以及变量定义，列出真值表。
2.惯用组合电路模块灵活应用
同样设计规定，用MSI设计完毕后，所得逻辑电路不但与所选芯片关于，并且还与设计者对芯片理解及灵活应用能力关于。读者可在下面例题和习题中体会。
3.硬件描述语言VHDL应用
VHDL应用非常灵活，同一种电路问题可以有不同描述办法，初学者可以先仔细阅读已有程序实例，再自行设计。
三、考核题型与考核重点
1.概念与简答
题型1为填空、判断和选取；
题型2为论述基本概念与特点。
建议分派分数为3～6分。
2.综合分析与设计
题型1为依照已知电路分析逻辑功能；
题型2为依照给定逻辑问题，设计出满足规定逻辑电路。
建议分派分数为6～12分。
第二节思考题题解
题3.1简述组合逻辑电路分析环节和设计环节。
答：组合逻辑电路分析是用逻辑函数来描述已知电路，找出输入、输出间关系，从而判断电路功能。组合逻辑电路分析有如下几种环节：一方面依照逻辑电路图写出逻辑函数表达式，然后运用代数法或图解法化简函数，列出真值表，最后依照真值表判断电路逻辑功能。
组合逻辑电路设计是依照实际逻辑问题，求出实现相应逻辑功能最简朴或者最合理数字电路过程。逻辑电路设计环节如下：
一方面分析设计规定，建立真值表，选取所用门类型，将逻辑表达式化为最简形式，或者变换为最合理表达式，最后画出逻辑图。
题3.2组合逻辑电路如思考题3.2图（a）所示。
（1）写出函数F表达示。
（2）将函数F化为最简与或式，并用与非门实现之。
（3）若改用或非门实现，试写出相应表达式。
A
AC
思考题3.2图
≥1
F
AB
CD
BD
AC
（a）
F
ABD
BCD
（b）
F
≥1
CA
≥1
≥1
≥1
AB
AD
BC
（c）
≥1
DC
≥1
解：（1）依照题图3.3（a）已知电路，写出函数F表达式如下：
F=
（2）将函数F化简为最简与或表达式，并用与非门实现。
F=
依照与非表达式画出用与非门实现电路如思考题3.2图（b）所示。
（3）若改用或非门实现，一方面写出相应表达式。
画出卡诺图，得到与或式，从而求出F与或非式，变换得到或非-或非式。
F=
=
函数F或非门电路如思考题3.2图（c）所示。
题3.3什么叫竞争-冒险现象？当门电路两个输入端同步向相反逻辑状态转换（即一种从0变成1，另一种从1变成0）时，输出与否一定有干扰脉冲产生？
答：竞争指是一种门电路各种输入信号同步跳变，或者一种信号通过不同途径传到同一种门电路输入端导致信号到达时间不同现象。冒险指是由于竞争也许在电路输出端产生毛刺现象。当门电路两个输入端同步向相反逻辑状态转换时，输出不一定有干扰脉冲产生。
3.4简述VHDL重要长处。
答：VHDL覆盖面广，描述能力强，是一种多层次硬件描述语言，VHDL已成为IEEE承认一种工业原则，是一种通用硬件描述语言。
VHDL有良好可读性，可以被计算机接受，也容易被读者理解，VHDL源文献既是程序又是技术人员之间互换信息文献，也可作为合同签约者之间文献；VHDL生命周期长，由于VHDL硬件描述与工艺无关；VHDL支持大规模设计分解和已有设计再运用。
题3.5一种VHDL设计与否必要有一种构造体？构造体目是什么？一种设计可以有各种构造体吗？
答：VHDL
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