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**阅读下图，

分析IO端口地址当且仅当A9~A2，与非门的输出为0；否则与非门输出均为1.A1~A0为片内译码的地址读写控制10111110011010该接口电路内部共4个端口第30页,共59页，2024年2月25日，星期天**b）固定式多端口地址译码电路采用译码器设计译码电路；常用译码器简介：3-8译码器74LS138（外部特性图、内部结构图、逻辑功能表）4-16译码器74LS154（外部特性图、内部结构图、逻辑功能表）双2-4译码器74LS139（外部特性图、内部结构图、逻辑功能表）双2-4译码器74LS155（外部特性图、内部结构图、逻辑功能表）译码器译码的特点：一般对多个连续的地址或地址段进行译码。译码器的多个输出分别对应于不同端口或接口的选通信号。第31页,共59页，2024年2月25日，星期天**74LS138译码器外部特性图地址输入引脚输入信号A、B、C:将所要译码的三位地址信号引入译码器。输出信号Y0#~Y7#:译码之后的选通信号，可选择8个端口或接口使能信号G1、G2A#、G2B#:当且仅当G1＝1、G2A#＝0、G2B#＝0时，译码器正常工作。使能控制引脚选通信号输出引脚第32页,共59页，2024年2月25日，星期天**74LS138译码器内部结构图第33页,共59页，2024年2月25日，星期天**74LS138译码器逻辑功能表第34页,共59页，2024年2月25日，星期天**74LS154译码器外部特性图使能信号输入信号第35页,共59页，2024年2月25日，星期天**74LS154译码器内部结构图第36页,共59页，2024年2月25日，星期天**74LS154译码器逻辑功能表第37页,共59页，2024年2月25日，星期天**74LS139译码器的外部特性图第38页,共59页，2024年2月25日，星期天**74LS139译码器的内部结构图第39页,共59页，2024年2月25日，星期天**74LS139译码器的逻辑功能表第40页,共59页，2024年2月25日，星期天**A2A2分析IO端口地址当且仅当A9~A6=1010时，与非门输出为0；则使译码器74LS138的G2B#=0Y0#接接口芯片的片选，则输入的地址A5~A3=000时，该接口电路被选中。A2~A0作为片内端口选择的地址信号，表示该接口电路中共有8个端口。101101001101第41页,共59页，2024年2月25日，星期天**例2.使用译码器设计一个系统板上接口芯片的I/O端口地址译码电路，并且让每个接口芯片内部的端口数目为32个。输入信号：端口地址A9~A0、AEN、及IOR#、IOW#地址信号的分配：系统板上I/O端口地址范围为000~0FFH，则译码地址为A7~A0；每个接口芯片内部的端口数目为32个，则片内译码地址为A4~A0;故，片间译码的地址为A7~A5，可以使用3-8译码器；74LS138的外部信号：地址输入信号：A、B、C（A7~A5）；使能输入信号：G1、G2A#、G2B#（AEN、A8、A9）片选输出信号：各接口芯片的选通信号第42页,共59页，2024年2月25日，星期天**固定式多端口地址译码电路ABCG1G2A#G2B#74LS138Y0#Y1#Y2#Y3#Y4#Y5#Y6#Y7#A5A6A7AENA8A90000000111111100000?????即000～01FH接DMAC的片选端00001?????即020～03FH接中断控制器的片选端00010?????即040～05FH接定时/计数器的片选端100IOW#74LS32DMA页面寄存器的片选写信号(80H～9FH)74LS32NMI屏蔽寄存器的片选写信号该电路的译码地址范围是0～0FFH若该电路的译码地址范围改为100~1FFH，该如何设置？第43页,共59页，2024年2月25日，星期天**c）利用地址开关、译码器、比较器设计可选式译码电路译码电路设计结构固定译码部分：使用译码器做固定式多端口译码；可选译码部分：使用地址开关和比较器选择地址范围；比较器比较的对象地址开关的状态、地址总线上的信号；比较器比较的结果采用A=B的输出结果，作为固定译码部分的