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第10章触发器和时序逻辑电路;结构特点：
1.除有组合逻辑电路外，时序电路中还有触发器等器件构成的存储电路。因此具有记忆过去输入信号的能力。
2.存储电路的状态()反馈到输入端与输入信号共同决定其组合的输出。;10.1双稳态触发器;10.1.1R－S触发器;触发器输出与输入的逻辑关系;设原态为“0”态;0;设原态为“1”态;1;设原态为“1”态;1;基本R－S触发器状态表;基本RS触发器的工作波形;10.1.2时钟触发器;时钟触发器的触发方式：
（1）边沿触发
只在有效沿接受控制信号，并进行状态更新
（2）电平触发
只在有效电平接受控制信号，并进行状态更新
（3）主从触发
高电平期间接受控制输入信号，时钟脉冲由高变低后，进行状态更新;;CP=0时;CP=1时;RS触发器的功能表;;功能表;时序图;D触发器状态表;例：D触发器工作波形图;触发器逻辑功能的转换;10.2时序逻辑电路分析
1.时序逻辑电路某一时刻的输出，不仅与当前的输入有关，还与过去的输入有关。
2.时序逻辑电路的状态
时序逻辑电路中各触发器状态的集合称为该时刻逻辑电路的状态。如果一个时序逻辑电路有n个触发器，则该时序逻辑电路应有个不同状态。
;3.时序逻辑电路的分类
a.同步时序逻辑电路，各触发器的状态在统一的时钟脉冲控制下发生变化。
b.异步时序逻辑电路，没有时钟脉冲，或者虽有时钟脉冲，但各触发器的状态更新不是同步进行的。;10.2.1时序逻辑电路的分析;例1分析如下电路;2.状态方程;5.状态转换图;10.3寄存器;10.3.1数码寄存器;10.3.2移位寄存器;寄存数码;1;左移寄存器波形图;1;寄存器分类;3.双向移位寄存器：;10.4计数器;10.4.1二进制计数器;二进制数
Q2Q1Q0;1;异步二进制加法器工作波形;用D触发器构成三位二进制异步加法器;2.同步二进制加法计数器;二进制数
Q2Q1Q0;四位二进制同步加法计数器级间连接的逻辑关系;三位同步二进制加法计数器;C;例:分析图示逻辑电路的逻辑功能,说明其用处。
设初始状态为“000”。;解：1.写出各触发器
J、K端和C端的逻辑表达式;解：当初始状态为“000”时，
各触发器J、K端和C端??电平为;0;异步模五计数器工作波形
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