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本公开涉及保护集成电路免受静电放电。ESD保护电路包括第一电压限制器,该第一电压限制器具有通过在集成电路操作期间以反向偏置安装的第一二极管电耦合到集成电路的每个第一信号焊盘的第一输入端子。第一电压限制器被安装成在第一信号焊盘上的正ESD期间在每个第一信号焊盘与地之间导通。第二电压限制器电耦合到并安装成在外部电源焊盘与地之间在与第一电压限制器相同方向上导通。内部节点向域输出内部电源电压,并且响应于电源焊盘上的正ESD而被比通过第一电压限制器的电流低的电流通过。阻塞二极管电连接在第一输入端子与电源焊
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN118057689A
(43)申请公布日2024.05.21
(21)申请号202311559363.4
(22)申请日2023.11.21
(30)优先权数据
22121052022.11
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