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本发明属于超导集成电路技术领域，具体涉及一种带时钟比较器的超导接口电路。本发明通过在接口电路输入端插入带时钟的比较器，并通过增加DC‑SFQConverter将与后级约瑟夫森锁存驱动器JLD的交流偏置同频的参考时钟转化为可供比较器使用的脉冲时钟，可以大大降低输入端噪声毛刺等干扰信号带来的影响。此外通过单独控制比较器输入端的直流偏置，可以调节对输入信号的识别区间，进一步提高与前级不同的待放大超导电路之间的适配能力，从而实现了一个同时具有抗干扰能力和灵活性的超导接口电路。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN118100904A
(43)申请公布日2024.05.28
(21)申请号202410247531.4
(22)申请日2024.03.05
(71)申请人电子科技大学
地址611731
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