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HY5DU12422BTPCheckingCompatibility3/8
•Extractfilesfrom‘HY5DU12422BTP_spice.zip’underanydirectorywherethe
simulationwouldbeexecuted.
•Runasimulationwith‘512MDDR_CA.sp’astheinputdeckforcmd/addrbuffer.
•Runasimulationwith‘512MDDR_CLK.sp’astheinputdeckforclockinputbuffer.
•Runasimulationwith‘512MDDR_DM.sp’astheinputdeckfordminputbuffer.
•Runasimulationwith‘512MDDR_DQ.sp’astheinputdeckfordatain/outbuffer.
•Ifyoucouldseethesameresultastheoneseenonpage8ofthismaterial,our
modelwouldbecompatiblewithyoursimulationenvironment.
MemoryDesignTeam
HY5DU12422BTPSchematic(Cmd/Addr.Buffer)4/8
Controlpin
InputbufferEnable:EN(Highactive)
Cmd/Addr.Input:CA
Referencevoltage:VREF
OutputofInputBuffer:CA_OUT
PKG
CA+
MODEL
CA_OUT
VREF-
EN
MemoryDesignTeam
HY5DU12422BTPSchematic(CLKBuffer)5/8
Controlpin
InputbufferEnable:EN(Highactive)
DifferentialCLKInput:CLK/CLKB
Referencevoltage:VREF
OutputofCLKBuffer:OUT
PKG
CLKMODEL+
CLK_OUT
CLKBPKG-
MODEL
EN
MemoryDesignTeam
HY5DU12422BTPSchematic(DQBuffer)
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