期中包括实验工程代码用到等.pdfVIP

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1

AA定义

CSRDWR10

D0124Vcc01000写入计数器0

D1223WR

D2322RD01001写入计数器1

D3421CS

D4520A101010写入计数器2

D5619A0

D67825318CLK201011写入控制寄存

D7817OUT2器

CLK0916GATE2

OUT01015CLK100100读计数器0

GATE01114GATE100101读计数器1

GND1213OUT1

00110读计数器2

00111无操作

1××××使用

011××无操作

2

(2)硬件启动

◼写入计数初值后并不启动计数,而是在门控信号GATE由低

电平变高后,再经CLK信号的上升沿采样,在该CLK的

下降沿才开始计数。

◼由于GATE信号与CLK信号不一定同步,故在情况下,

从GATE变高到CLK采样之间的延时可能会经历一个CLK脉

冲宽度,因此在计数初值与实际的CLK脉冲个数之间也会有

一个时钟脉冲的误差。

3

2.8253的工作方式

方式启动计数中止计数自动更新初值输出波形

重复

0软件(写入初值)GATE=0否立即有效延时时间可变的上

跳沿

1硬件(GATE正跳变)否下一轮有效宽度为N×TCLK的

单一负脉冲

2软件(写入初值)GATE=0是下一轮有效周期为N×TCLK、

硬件(GATE正跳变)宽度为TCLK的连续

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